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基于VHDL的数字频率计设计
被引量：
1
Design of Digital Cymometer Based on VHDL
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摘要
利用可编程逻辑器件(CPLD),以EDA工具为开发平台,运用VHDL语言,设计一个10K～9.9MHz的数字频率计。
This article introduces a digital cymometer＇s design which based on the VHDL with CPLD and EDA development platform.
作者
熊秋娥
熊英华
机构地区
南通大学现代教育技术中心
江西南昌齿轮责任有限公司
出处
《现代计算机》
2007年第3期87-90,共4页
Modern Computer
关键词
VHDL
数字频率计
EDA
CPLD
VDHL
Digital Cymometer
EDA
CPLD
分类号
TM935.1 [电气工程—电力电子与电力传动]
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