GHz波段跳频锁相环关键技术研究

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摘要介绍了一种除低通滤波器片外单片集成锁相环(Phase-LockedLoop,PLL)频率综合器设计。整个设计对压控振荡器、双模预分频器(Dual-ModulusPrescaler,DMP)与电荷泵(ChargePump,CP)等锁相环关键模块分别作了优化与改进,提高了各项设计性能。压控振荡器(VoltageControlledOscillator,VCO)输出最高频率为1.25GHz时相位噪声为-118.43dBc/Hz@1MHz,VCO调谐范围为250MHz。双模预分频器实现了高精度低抖动低功耗设计,双模预分频器分频输出118.3MHz时,峰峰抖动小于20ps而功耗仅3.2mA。

作者徐勇王志功关宇赵斐阎小静何敏孙峥聂典

机构地区解放军理工大学理学院东南大学射频与光电集成电路研究所解放军理工大学气象学院

出处《中国集成电路》 2006年第6期20-23,43,共5页 China lntegrated Circuit

关键词锁相环压控振荡器关键模块频率综合器低通滤波器频率合成器带通滤波器双模预分频器跳频双模分频器

分类号 TN74 [电子电信—电路与系统]

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