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分析时序逻辑电路的快捷方法

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摘要分析时序电路在写出状态方程组之后,过去采用代入法列出状态表,对于有m个状态量的电路,有m×2~m个方程式待代入计算,而且“0”与“1”两个数码重复出现是枯燥的,易出现疲劳错漏,且难以校核.另外,所列的状态表往往按二进制排列,翻译成状态图或时序图查阅亦费力.

作者周润文

机构地区华南理工大学电工教研室

出处《电气电子教学学报》 1991年第4期26-31,共6页 Journal of Electrical and Electronic Education

关键词时序逻辑电路快捷方法卡诺图状态表状态图时序图状态量原码逻辑函数四列

分类号 TN-4 [电子电信]

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电气电子教学学报

1991年第4期

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