大整数乘法器设计被引量：4

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摘要本文提出了一种有符号大整数乘法的实现算法，该算法避免了部分积的符号扩展，使部分积之间的累加比较规则，易于VLSI实现。并且文中给出了该算法的一种逻辑实现结构，这种结构减少了乘法计算过程中进位传递加法的次数，加快了乘法计算的速度。

作者原巍许琪沈绪榜

机构地区西安微电子技术研究所

出处《微电子学与计算机》 CSCD 北大核心 2003年第B12期1-3,7,共4页 Microelectronics & Computer

关键词大整数乘法器算法符号扩展部分积 VLSI实现逻辑实现结构

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微电子学与计算机

2003年第B12期

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