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一种新的8B／10B编解码硬件设计方法 被引量：4

A new hardware implementing design of 8B/10B encoding and decoding
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摘要 在深入研究了8B/10B编码规则及其内在相关性的基础上,提出了一种新的8B/10B编、解码方法,该方法综合了查表法和逻辑运算法的优点,具有运算量小、编解码同步好、速度快、可靠性高等优点.用Verilog HDL语言实现编解码算法的描述,并通过高性能的FPGA器件进行仿真和综合,实现了具体的硬件电路,并验证了设计方法的有效性和可行性.
作者 贺传峰 戴居丰 毛陆虹
机构地区 天津大学电子信息工程学院光纤通信研究所
出处 《高技术通讯》 CAS CSCD 北大核心 2005年第3期48-52,共5页 Chinese High Technology Letters
基金 国家高技术研究发展计划(863计划)
关键词 编解码 HDL语言 硬件设计 同步 FPGA器件 查表法 算法 8B/10B 逻辑运算 硬件电路
分类号 TP336 [自动化与计算机技术—计算机系统结构] TN919 [电子电信—通信与信息系统]
  • 相关文献

参考文献5

  • 1RichSeifert.千兆以太网技术与应用[M].北京：机械工业出版社,2000..
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  • 3Widmer A X,Franaszek P A. A DC-balance,partitioned-block,8B/10B transmission code. IBM Journal of research and development,1983,23(5):441.
  • 4Cisco White Paper.Very short reach OC-192/STM-64 interface: optimizing for network Intra-POP interconnections. P2.
  • 5OIF-VSR4-01.0,very short reach(VSR)OC-192/STM-64Interface based on Parallel Optics.Optical Internetworking Forum,2000,18.

二级参考文献1

  • 1赵文虎 王志功.千兆以太网及VLSI集成电路设计[J].计算机应用与研究,2002,03(6).

共引文献26

同被引文献17

引证文献4

二级引证文献23

高技术通讯
2005年 第3期

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