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以时延优化为目标的布线算法研究
A VLSI Routing Algorithm with Minimum Deviation of Timing Delay
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摘要
布线算法以线网时延方差最小和时延均值小为目标,满足大规模并行系统和同步系统的需要,具有方法独特、可并行处理等特点,实验结果运作良好。
作者
冯志全
樊晓桠
张盛兵
机构地区
西北工业大学
出处
《西北工业大学学报》
EI
CAS
CSCD
北大核心
1995年第3期453-457,共5页
Journal of Northwestern Polytechnical University
关键词
VLSI
布线
优化
芯片
时延
算法
VLSI, route, deviation, timing delay
分类号
TN402 [电子电信—微电子学与固体电子学]
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西北工业大学学报
1995年 第3期
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