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微处理器浮点IP核集成设计 被引量：1

The Integration of Floating Point IP in Microprocessor Design
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摘要 探讨了一个可靠性高,通讯代价低的浮点IP集成方案。浮点运算IPFXU采用80bit扩展精度,支持i960mc的浮点指令集。为了在兼容X86指令集的32bit处理器系统中,实现IP核的集成,精心设计了耦合单元(FIU),以完成数据请求的拆分,指令匹配,数据的打包、卸包和处理器的同步控制。 A floating point computing unit IP FXU is integrated in the 32bit embedded microprocessor amec86. For coupling the IP and supporting the 80bit extended_real computing , FIU is designed to split memory access,transform the format of instructions and datas,and synchronize the floating point unit with other units.
作者 赵勇 张盛兵 王党辉
机构地区 西北工业大学航空微电子中心
出处 《微电子学与计算机》 CSCD 北大核心 2006年第7期129-133,共5页 Microelectronics & Computer
基金 "十五"预研项目(41308010307)
关键词 浮点IP 耦合单元 集成 Floating point IP, Coupling unit, Integration
分类号 TP3 [自动化与计算机技术—计算机科学与技术]
  • 相关文献

参考文献4

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同被引文献14

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引证文献1

微电子学与计算机
2006年 第7期

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