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FPGA的多路可控脉冲延迟系统 被引量:2

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摘要 采用数字方法和模拟方法设计了一种最大分辨率为0.15ns级的多路脉冲延迟系统,可以实现对连续脉冲信号的高分辨率可控延迟;采用Flash FPGA克服了现有SRAM FPGA系统掉电后程序丢失的缺点,提高了系统反应速度。本系统适用于需要将输入脉冲信号进行精确延迟来产生测试或控制用的连续脉冲信号场合,具有很强的适用性。
作者 程璐 郭文成
机构地区 天津工业大学
出处 《单片机与嵌入式系统应用》 2008年第7期41-42,45,共3页 Microcontrollers & Embedded Systems
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参考文献4

二级参考文献3

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共引文献138

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引证文献2

二级引证文献8

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