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避免快速存取RAM设计中的总线争用

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摘要当设计一个面向总线的系统时，必须考虑总线争用的可能性。当两个或更多器件在同一共同总线上试图输出相反的逻辑电平时，就会发生争用现象。本文指出在用快速静态ＲＡＭ设计时总线争用的常见原因，并描述消除或减少总线争用的方法。总线争用最常见的形式发生在一个器件在...

出处《电子产品世界》 1998年第3期82-83,共2页 Electronic Engineering & Product World

关键词快速存取RAM 总线争用随要存储器设计

分类号 TP333.802 [自动化与计算机技术—计算机系统结构]

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