智原科技发表65nm及55nm miniIO,可节省40%的芯片面积,并兼具稳固的ESD效能

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摘要 ASIC设计服务暨IP研发销售领导厂商一智原科技（Faraday Technology）于近日发表65nm及55nm的超轻巧IO-minilO。相较于一般IO pad．minilO可大幅节省芯片面积。以500个接脚的IO pad设计为例，minilO可减少40％的面积，同时兼具稳固的ESD效能及相同的程序化IO功能。

出处《电子与电脑》 2009年第9期78-78,共1页 Compotech

关键词芯片面积 ESD 科技设计服务 ASIC PAD 程序化

分类号 TB852.1 [一般工业技术—摄影技术] TM08 [电气工程—电工理论与新技术]

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