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手把手教你学 CPLD/FPGA设计(十一)上
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摘要
组合逻辑电路的设计实验 数字逻辑电路系统按功能的不同,可以分为组合逻辑电路和时序逻辑电路两大类。组合逻辑电路在任意时刻产生的输出只取决于该时刻的输入,而与电路过去的输入无关。常见的组合逻辑电路有数据选择器、编码器、译码器、加法器等。
作者
周兴华
出处
《电子世界》
2009年第11期24-27,共4页
Electronics World
关键词
PLD/FPGA设计
组合逻辑电路
把手
时序逻辑电路
数据选择器
设计实验
电路系统
数字逻辑
分类号
TN791 [电子电信—电路与系统]
TP311 [自动化与计算机技术—计算机软件与理论]
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