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基于IP核的FIR低通滤波器的设计与FPGA实现 被引量:1

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摘要 本文利用FIR有限冲击响应滤波器IP核,设计了截止频率为500Hz的FIR低通滤波器,在Simulink中建立了仿真模型并进行了仿真。最终在EP2C35F672C8型号FPGA上得到了最高响应频率为151.88MHz的高速FIR低通滤波器。设计效率和滤波器性能得到了极大的提高。
作者 陈建忠
出处 《科技信息》 2012年第4期224-225,共2页 Science & Technology Information
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参考文献4

二级参考文献11

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共引文献21

同被引文献6

引证文献1

二级引证文献1

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