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华力微电子基于Cadence公司Encounter数字技术开发55纳米平台的参考设计流程
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摘要
Cadence设计系统公司(NASDAQ:CDNS)与上海华力微电子有限公司日前共同宣布,华力微电子基于Cadence Encounter 数字技术交付出55纳米平台的参考设计流程。从现在起,华力微电子首次在其已建立的55纳米工艺平台上实现了从RTL到GDSII的完整流程,这也是Cadence与上海华力紧密合作的结果。
出处
《中国集成电路》
2013年第9期10-10,共1页
China lntegrated Circuit
关键词
Cadence公司
参考设计流程
纳米工艺
Cadence设计系统公司
平台
技术开发
子基
数字技术
分类号
TN402 [电子电信—微电子学与固体电子学]
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1
华力微电子与Cadence紧密合作[J]
.电子技术应用,2013,39(9):37-37.
2
中芯国际和新思科技携手[J]
.数字通信世界,2009(7):83-83.
3
Synopsys与华虹NEC共同推出参考设计流程[J]
.中国集成电路,2004(4):63-63.
4
CADENCE与UMC合作推出基于CPF的65纳米低功耗参考设计流程[J]
.集成电路应用,2008(7):14-14.
5
中芯国际和新思科技扩展40nm低功耗Reference Flow 5.0[J]
.中国集成电路,2012(7):5-5.
6
Synopsys与华虹NEC共同推出参考设计流程[J]
.电子设计应用,2004(5):101-101.
7
国内新闻[J]
.半导体行业,2006(5):50-52.
8
Imagination与台积电合作开发高级IoTIP平台[J]
.单片机与嵌入式系统应用,2015,15(8):86-86.
9
lmagination与TSMC合作开发高级IoTIP平台[J]
.中国集成电路,2015,24(7):11-11.
10
Synopsys与华虹NEC共同推出参考设计流程[J]
.电子产品世界,2004,11(05A):89-89.
中国集成电路
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