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FPGA与DSP的总线接口验证
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摘要
由于环境的变化,导致DSP+FPGA之间总线时序在通讯过程中会出现微小变化,能够影响二者接口的可靠性。本文通过使用FPGA对模拟实际DSP的总线时序,可以充分地、快速地对DSP+FPGA之间总线接口的可靠性验证。
作者
孙亮
机构地区
中国科学院长春光学精密机械与物理研究所
出处
《计算机光盘软件与应用》
2013年第22期275-275,277,共2页
Computer CD Software and Application
关键词
FPGA
接口时序
仿真
分类号
TN957.51 [电子电信—信号与信息处理]
引文网络
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计算机光盘软件与应用
2013年 第22期
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