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FPGA数字脉冲压缩系统的研究与实现 被引量:1

Research and realization on FPGA digital pulse compression system
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摘要 针对线性调频信号用FPGA IP核进行设计并实现了单通道的数字脉冲压缩系统.阐述了数字下变频、脉冲压缩的原理.介绍了系统的硬件结构、主要设计模块和在FPGA上实现对中频线性调频信号进行脉冲压缩处理的方法.最后给出了MATLAB仿真和FPGA硬件实验测试结果,验证了文中给出的数字脉冲压缩器设计的工程可行性. A signal-channel digital pulse compression (DPC) system is implemented for the LFM signal and the DPC module is designed by using FPGA IP core. This paper describes the theory of digital down conversion and pulse com- pression, introduces the hardware structure and main design module of system, and the method on pulse compression for intermediate frequency LFM signal in FPGA. Finally, the authors give the testing results on MATALB simulation and FP- GA hardware experiment, demonstrating the engineering feasibility of the design on DPC system given in this paper.
出处 《应用科技》 CAS 2013年第6期59-62,共4页 Applied Science and Technology
基金 国家自然科学基金资助项目(60772025)
关键词 雷达 脉冲压缩 数字下变频 IP核 FPGA radar pulse compression digital down conversion IP core FPGA
  • 相关文献

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共引文献5

同被引文献8

引证文献1

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