80C186XL嵌入式系统中DRAM控制器的CPLD解决方案
摘要
介绍怎样在嵌入式CPU 80C186XL DRAM刷新控制单元的基础上,利用CPLD技术和80C186XL的时序特征设计一个低价格、功能完整的DRAM控制器的方法,并采用VHDL语言编程实现。
出处
《单片机与嵌入式系统应用》
2001年第11期12-15,共4页
Microcontrollers & Embedded Systems
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