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DDR2硬件设计中反射的消除

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摘要 本文主要针对高速电路DDR2硬件设计中,影响信号SI和PI的各种相关因素做了介绍。对于在8层电路板里设计800Mbps以上的DDR2是可行的,实现DDR2时序匹配和信号的准确性和完整性。
作者 贺敬
出处 《山东工业技术》 2015年第3期188-188,共1页 Journal of Shandong Industrial Technology
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参考文献3

二级参考文献12

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