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基于UVM的千兆网络适配器IP的验证环境 被引量:2

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摘要 目前嵌入式系统的流行,使得SOC的设计在业界越来越多,而且于此带来的验证挑战也越来越大,本文描述了一种基于AXI4.0总线接口的以太网IP设计和验证环境。
作者 许诺
出处 《中小企业管理与科技》 2016年第4期221-221,共1页 Management & Technology of SME
  • 相关文献

参考文献1

二级参考文献6

  • 1BERGERON J.writing testbenches using systemVerilog [M].New York Springer-Verlag, 2006.
  • 2Accellera,UVM 1.0 Reference Manual,2011.
  • 3Accellera,Universal Verification Methodology (UVM)I.0 User' s Guide[M],2011.
  • 4Clifford E,Cummings and Tom Fitzpatrick.OVM&UVM Te- chiniques for terminating tests[M].DVCon,2010.
  • 5Bergeron J,Nightingai A.Verification methodology manual for SystemVerilog [M].New York: Springer-Verl ag, 2006.
  • 6Sharon Rosenberg and Kathleen A Meade.A practical guide to Adopting the universal verification methodology (UVM)[M].Cadence Design Systems,2010.

共引文献2

同被引文献2

引证文献2

二级引证文献3

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