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Math Works加快FPGA在环验证
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摘要
Math Works发布了HDL Verifier中的新功能,用来加快FPGA在环(FIL)验证。利用新的FIL功能,可以更快地与FPGA板通信,实现更高的仿真时钟频率。现在,系统工程师和研究人员可以自信地快速确认和验证FPGA设计住系统中按预期方式工作,从而节省开发时间。
出处
《今日电子》
2017年第1期103-104,共2页
Electronic Products
关键词
FPGA设计
MATH
验证
系统工程师
时钟频率
研究人员
HDL
FIL
分类号
TN402 [电子电信—微电子学与固体电子学]
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