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一种高频时钟分频电路 被引量:1

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摘要 本设计提出一种用于对高频时钟进行多级分频的电路,具有低延迟的特点,能满足分频后的时钟和源时钟具有相对同步的相位关系,同时面积相对较优。
作者 李乾男
出处 《中国集成电路》 2022年第8期49-51,共3页 China lntegrated Circuit
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