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利用有限资源实现高速Viterbi解码

The Implementation of High - speed Viterbi Decode Based on Finite Resource
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摘要 文中提供一种分组方法简单,兼顾连线复杂性与存储空间有限性的Viterbi解码方法,并提出三种处理方法,可以依据实际情况选定所需的处理结构。 In this paper, we present a simple approach of partitioning the N trellis states to P groups in Viterbi decoder, which compatible with interconnection complexity and area saving, and three scheme is proposed, you can choose any of them in your need.
作者 王丽 王金刚
机构地区 天津大学
出处 《电子测量技术》 2003年第2期39-40,共2页 Electronic Measurement Technology
关键词 VITERBI解码 加比选单元 路径量度 支路量度 卷积码 分组 Viterbi decode ACS(Add - Compare- Select) Path metric Branch metric
  • 相关文献

参考文献3

  • 1宣建华,姚庆栋.高速Viterbi处理器——流水式块处理并行结构[J].通信学报,1995,16(1):94-100. 被引量:3
  • 2Montse Boo, Frandseo Arguello."High- Performance VLSI Architecture for the Viterli Algorithm. IEEE Transactions on communications, Vol. 45, No. 2, PP. 168-176, Feb. 1997.
  • 3Mare Biver and Hubert Kaeslin, " In- place Updating of Path Metrics in Viterbi Decoders. IEEE Journal of Solid- State Circuits,Vol. 24, No. 4, PP. 1158-1160, Aug. 1989.

共引文献2

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