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异步十进制可逆计数器的设计

The asynchronous decimal up-down counter of design
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摘要 通过对异步十进制加法、减法计数器的分析 ,进一步设计出既能完成加法计数又能完成减法计数的逻辑电路即可逆计数器 。
机构地区 河西学院物理系
出处 《甘肃高师学报》 2003年第5期6-7,共2页 Journal of Gansu Normal Colleges
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