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高速位误码率测试仪的设计与实现

Design and realization of high-speed BER testing instrument
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摘要  介绍了高速位误码率测试仪的结构,给出具体的设计方法,并对其具体实现进行了详细的介绍。 The authers introduced the structure, design and realization of a high-speed Bit Error Rate (BER) testing instrument.
出处 《电光与控制》 2004年第2期54-56,共3页 Electronics Optics & Control
关键词 ECL FPGA 误码率 帧同步 ECL FPGA BER frame synchronization
  • 相关文献

参考文献5

  • 1High performance ECL Data on Semiconductor[M]. 2001.
  • 2ECLinPS Plus Device Data on Semiconductor[M] .2001.
  • 3MECL System Design Handbook on Semiconductor [M].2000.
  • 4赵保经.中国集成电路大全,ECL集成电路[M].北京:国防工业出版社,1986..
  • 5徐志军 徐光辉.CPLD/FPGA的应用于开发[M].北京:电子工业出版社,2002..

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