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基于VHDL的数字频率计设计 被引量:1
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作者 熊秋娥 熊英华 《现代计算机》 2007年第3期87-90,共4页
利用可编程逻辑器件(CPLD),以EDA工具为开发平台,运用VHDL语言,设计一个10K~9.9MHz的数字频率计。
关键词 VHDL 数字频率计 EDA CPLD
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