基于时钟控制的低功耗电路设计

在低功耗芯片设计中,设计者已广泛采用了时钟停止的方法来解决CMOS电路动态功耗问题。为实现时钟停止功能,作者分析了多种传统时钟控制电路方案,并在此基础上提出了一种新型可综合可测试的时钟控制电路。相对于传统时钟控制电路,此种方案在降低芯片功耗的同时解决了传统时钟控制电路所带来的时钟不稳定及无法进行测试的问题。

一种消除内存访问等待的DSP内存控制设计

随着数字信号处理器主频的不断提高,其中的运算单元已由单层流水线结构向多层流水线结构变迁。但随之带来了访问内存时出现等待周期的问题。文章提出了读写分层及硬件写回缓冲的设计,消除了访存单元等待周期,使访存单元获得100%的工作效率。

一种应用于DSP的快速位提取和插入实现方法

介绍了一种快速的位提取和插入实现方法。该方法通过使用快速的与或逻辑电路而不是较慢的多选1电路来减小时延;通过器件复用技术来减小面积。仿真和综合结果表明该方法大大优化了DSP的时延和面积,有助于提高DSP整体的运算速度和降低功耗。

高性能DSP位操作加速器设计

介绍了一种高性能DSP位操作加速器实现方法。该方法通过使用分层位操作电路取代分层MUX选择电路实现位操作加速来减少电路时延,使得位操作加速器的时间复杂度从O(N)降到了O(log 2 N)。综合结果表明使用该方法设计的32-位位操作加速器有很大的性能提升。

一种改进的DSP内存控制单元

高性能内存控制单元对于提高DSP芯片性能具有非常重要的意义。本文讨论并提出了多种内存控制单元结构并详细讨论各自特点。这些内存控制单元使得整个芯片的工作性能得到了提高,达到芯片时延小于3ns的设计要求。