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利用匹配滤波改进MIMO预编码方案 被引量:4
1
作者 牛兰奇 张太镒 孙建成 《电子科技大学学报》 EI CAS CSCD 北大核心 2010年第5期684-687,共4页
针对多用户多输入多输出(MIMO)系统下行链路的共信道干扰(CCI)问题,提出了一种可以实现发射机和接收机联合设计的预编码方案。该方案假定接收机为匹配滤波器,避免了最小均方误差(MMSE)准则下发射机和接收机联合设计中的迭代操作,同时将... 针对多用户多输入多输出(MIMO)系统下行链路的共信道干扰(CCI)问题,提出了一种可以实现发射机和接收机联合设计的预编码方案。该方案假定接收机为匹配滤波器,避免了最小均方误差(MMSE)准则下发射机和接收机联合设计中的迭代操作,同时将迫零处理引入MMSE方法,完全消除了CCI。为进一步简化联合设计问题,对等效信道矩阵进行奇异值分解,将向量优化问题转化为标量优化问题。仿真结果表明,与其他非迭代的预编码方案相比,该联合设计的预编码方案可以获得更好的平均误比特率性能和总容量性能。 展开更多
关键词 匹配滤波器 最小均方误差 多输入多输出 预编码 迫零
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Turbo码在DVB-RCS标准中的应用 被引量:1
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作者 牛兰奇 刘高辉 余宁梅 《电视技术》 北大核心 2003年第11期29-30,37,共3页
分析了Turbo码的基本原理,讨论了CRSCTurbo码的特点,论述了在DVB-RCS中应用的双二元CRSCTurbo码的结构和实现方法。
关键词 TURBO码 循环递归系统卷积码 DVB—RCS标准 结构 数字电视广播
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凿孔卷积码距离谱的计算
3
作者 牛兰奇 张太镒 张璟 《西安电子科技大学学报》 EI CAS CSCD 北大核心 2008年第6期1089-1093,共5页
针对基于距离谱的凿孔卷积码优化设计问题,提出了一种高效的凿孔卷积码距离谱计算方法.利用卷积码状态图和凿孔码凿孔图样构造一个长度为凿孔周期的状态转移矩阵序列,并利用状态转移矩阵序列的乘积计算传输函数和距离谱.为了避免符号矩... 针对基于距离谱的凿孔卷积码优化设计问题,提出了一种高效的凿孔卷积码距离谱计算方法.利用卷积码状态图和凿孔码凿孔图样构造一个长度为凿孔周期的状态转移矩阵序列,并利用状态转移矩阵序列的乘积计算传输函数和距离谱.为了避免符号矩阵的求逆运算,又给出了基于状态逐步消除的传输函数计算方法.分析和仿真结果表明:这种方法既有较高的计算效率,又有很强的实用性,可以用来进行优化设计或者理论分析. 展开更多
关键词 凿孔卷积码 距离谱 转移矩阵 传输函数 状态消除算法
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采用帧延迟的实时编码协作方案
4
作者 牛兰奇 张太镒 张璟 《西安交通大学学报》 EI CAS CSCD 北大核心 2009年第2期63-66,共4页
为了解决码分多址(CDMA)和频分多址(FDMA)编码协作系统中协作用户之间存在的冲突和碰撞问题,提出了一种采用帧延迟的实时编码协作方案.该方案将用户信道码字分割为2部分,如果某个用户对协作伙伴前一帧数据成功译码,则将协作伙伴前一帧... 为了解决码分多址(CDMA)和频分多址(FDMA)编码协作系统中协作用户之间存在的冲突和碰撞问题,提出了一种采用帧延迟的实时编码协作方案.该方案将用户信道码字分割为2部分,如果某个用户对协作伙伴前一帧数据成功译码,则将协作伙伴前一帧码字的第2部分冗余作为协作信息传输,否则传输自身当前帧码字的第2部分冗余,从而实现实时编码协作.此外,还利用紧联合界技术推导了新方案的误比特率估计公式,给出了数值计算结果.数值结果表明:采用帧延迟的实时编码协作方案能够很好地解决CDMA和FDMA编码协作系统中协作用户之间的碰撞问题,但会有少量的性能损失,对于0 dB互易用户间信道,性能损失为1.2 dB. 展开更多
关键词 码分多址 频分多址 帧延迟 实时编码协作 紧联合界
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一种基于空频和星座编码的高效编码协作
5
作者 牛兰奇 张太镒 张璟 《系统仿真学报》 CAS CSCD 北大核心 2010年第1期140-143,共4页
协作分集可以有效地减轻无线信道衰落、改善无线通信系统性能。针对正交频分复用(OFDM)系统,提出一种高效编码协作协议。该协议将空频编码和星座编码相结合,可以提高频谱效率。推导了该协议的成对错误概率,分析了协作分集性能,给出了多... 协作分集可以有效地减轻无线信道衰落、改善无线通信系统性能。针对正交频分复用(OFDM)系统,提出一种高效编码协作协议。该协议将空频编码和星座编码相结合,可以提高频谱效率。推导了该协议的成对错误概率,分析了协作分集性能,给出了多径衰落信道下Viterbi译码器的判决度量计算公式。理论分析与仿真结果表明:新编码协作协议可以获得高频谱效率,用户间信道延迟扩展对系统误比特率(BER)性能影响较小,而上行链路信道的延迟扩展对系统BER性能影响较大。 展开更多
关键词 协作分集 编码协作 正交频分复用 空频编码 星座编码
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基于多元符号可信信息的RS码的软判决译码算法
6
作者 牛兰奇 刘高辉 《西安理工大学学报》 CAS 2002年第2期159-162,共4页
讨论了多元码可信信息的计算方法 ,提出了一种 RS( Reed-Solomon)码的软判决译码算法。这种译码算法是在计算多元符号的可信信息的基础上 ,依据 Chase译码算法的基本原理 ,将代数译码和码元符号的可信信息相结合 ,并进一步简化了试探错... 讨论了多元码可信信息的计算方法 ,提出了一种 RS( Reed-Solomon)码的软判决译码算法。这种译码算法是在计算多元符号的可信信息的基础上 ,依据 Chase译码算法的基本原理 ,将代数译码和码元符号的可信信息相结合 ,并进一步简化了试探错误图样产生方法。最后给出了在 AWGN信道上 ( 1 5,1 1 ,5) RS码的软判决译码算法的计算机模拟结果 。 展开更多
关键词 RS码 多元符号可信信息 软判决译码
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变参数RS编码器IP核的设计与实现 被引量:3
7
作者 董怀玉 余宁梅 +3 位作者 高勇 刘高辉 牛兰奇 陈静瑾 《固体电子学研究与进展》 CAS CSCD 北大核心 2004年第2期186-190,共5页
设计了一种码长可变、纠错能力可调的 RS编码器。该 RS编码器可对常用的 RS短码进行编码 ,可做成 IP核 ,为用户提供了很大的方便 ;采用基于多项式乘法理论 GF( 2 m)上的 m位快速有限域乘法的方法 ,提高了编码电路的运算速度 ;同时给出... 设计了一种码长可变、纠错能力可调的 RS编码器。该 RS编码器可对常用的 RS短码进行编码 ,可做成 IP核 ,为用户提供了很大的方便 ;采用基于多项式乘法理论 GF( 2 m)上的 m位快速有限域乘法的方法 ,提高了编码电路的运算速度 ;同时给出了程序仿真结果 ,并在 Xilinx的 FPGA上进行了硬件验证。 展开更多
关键词 RS编码器 IP核 有限域 专用集成电路 FPGA VERILOG HDL
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QPSK调制的WCDMA信号的一种数模混合型解扩方法 被引量:2
8
作者 刘高辉 余宁梅 +1 位作者 高勇 牛兰奇 《系统工程与电子技术》 EI CSCD 北大核心 2004年第10期1377-1380,1395,共5页
从降低解扩电路功耗和提高运算速度两方面考虑,针对采用QPSK调制的宽带码分多址(WCDMA)信号,提出了一种数模混合型解扩方法。该方法采用二阶采样保持技术对QPSK信号进行时域离散化和正交分解,通过数字控制的模拟匹配滤波器组在模拟域进... 从降低解扩电路功耗和提高运算速度两方面考虑,针对采用QPSK调制的宽带码分多址(WCDMA)信号,提出了一种数模混合型解扩方法。该方法采用二阶采样保持技术对QPSK信号进行时域离散化和正交分解,通过数字控制的模拟匹配滤波器组在模拟域进行相关运算。给出了二阶采样参数的选取原则和模拟匹配滤波器组的实现结构,通过仿真实验验证了该方法的有效性。与全数字的解扩方法相比,该方法无需高速A/D转换器和正交解调器。 展开更多
关键词 宽带码分多址 相关解扩 二阶采样 模拟匹配滤波嚣组 正交解调 数模混合型方法
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CDMA扩频信号的数模混合型解扩方法 被引量:2
9
作者 刘高辉 陈静瑾 +2 位作者 余宁梅 高勇 牛兰奇 《西安理工大学学报》 CAS 2003年第4期326-330,共5页
提出一种CDMA扩频信号的数模混合型解扩方法。该方法首先采用二阶采样实现中频信号的正交解调,再用数字控制的并行模拟运算电路实现的模拟匹配滤波器对基带信号进行相关解扩。仿真实验表明,该方法能实现CDMA扩频信号的相关解扩,而且实... 提出一种CDMA扩频信号的数模混合型解扩方法。该方法首先采用二阶采样实现中频信号的正交解调,再用数字控制的并行模拟运算电路实现的模拟匹配滤波器对基带信号进行相关解扩。仿真实验表明,该方法能实现CDMA扩频信号的相关解扩,而且实现电路结构简单,是一种有效的相关解扩技术。 展开更多
关键词 CDMA扩频信号 数模混合型解扩方法 二阶采样 匹配滤波器
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RS(15,9)编码器IP Core的实现 被引量:1
10
作者 董怀玉 余宁梅 +3 位作者 高勇 刘高辉 牛兰奇 陈静瑾 《西安理工大学学报》 CAS 2004年第1期82-86,共5页
RS编码器IP核设计的难点是提高编码电路的编码运算速度。采用基于多项式乘法理论的GF(2m)上4位快速有限域乘法的方法,提高了编码电路中乘法器模块的运算速度,并对传统的编码电路进行优化,从而解决了运算速度慢的问题。使用VerilogHDL语... RS编码器IP核设计的难点是提高编码电路的编码运算速度。采用基于多项式乘法理论的GF(2m)上4位快速有限域乘法的方法,提高了编码电路中乘法器模块的运算速度,并对传统的编码电路进行优化,从而解决了运算速度慢的问题。使用VerilogHDL语言和Verilog7.0软件,设计了RS(15,9)编码器,通过仿真及软、硬件验证了设计的正确性。 展开更多
关键词 RS码 编码器 IP CORE VERILOG HDL
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