一款10位逐次逼近型模数转换器设计

基于0.18μm CMOS工艺设计一款10位逐次逼近型模数转换器(SARADC),采用了阻容混合型的数模转换器(DAC)以实现面积与性能上的折衷,高位采用温度码设计以提高DAC的线性度。采用了失调电压较小的静态比较器结构,通过在DAC和比较器之间加入了高增益的前置放大器来消除比较器失调电压对ADC性能所带来的影响。仿真结果表明:在电源电压为2.8V、采样速率为116kS/s、输入信号频率约为57kHz、满摆幅为0.8V的情况下,ADC有效位数(ENOB)达9.99位,信噪失真比(SNDR)为61.9dB,无杂散动态范围(SFDR)为75.57dB,总功耗约为1mW,面积为0.069mm^2。