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Complex multiplier suited for FPGA structure
1
作者
keiichi satoh
Jubee Tad
+1 位作者
Yasutaka Tamura
Gensuke Goto
《通讯和计算机（中英文版）》
2009年第12期55-62,共8页
关键词
FPGA
乘数
WALLACE树
结构
有效利用
路径延迟
合成电路
现场可编程
下载PDF
职称材料
题名
Complex multiplier suited for FPGA structure
1
作者
keiichi satoh
Jubee Tad
Yasutaka Tamura
Gensuke Goto
机构
Department of System and Information Engineering
Department of Informatics
出处
《通讯和计算机（中英文版）》
2009年第12期55-62,共8页
关键词
FPGA
乘数
WALLACE树
结构
有效利用
路径延迟
合成电路
现场可编程
Keywords
complex multiplier
FPGA
LUT
carry-chain
分类号
TN791 [电子电信—电路与系统]
O121.4 [理学—基础数学]
下载PDF
职称材料
题名
作者
出处
发文年
被引量
操作
1
Complex multiplier suited for FPGA structure
keiichi satoh
Jubee Tad
Yasutaka Tamura
Gensuke Goto
《通讯和计算机（中英文版）》
2009
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