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A Low Power Non-Volatile LR-WPAN Baseband Processor with Wake-Up Identification Receiver
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作者 YU Shuangming FENG Peng WU Nanjian 《China Communications》 SCIE CSCD 2016年第1期33-46,共14页
The paper proposes a low power non-volatile baseband processor with wake-up identification(WUI) receiver for LR-WPAN transceiver.It consists of WUI receiver,main receiver,transmitter,non-volatile memory(NVM) and power... The paper proposes a low power non-volatile baseband processor with wake-up identification(WUI) receiver for LR-WPAN transceiver.It consists of WUI receiver,main receiver,transmitter,non-volatile memory(NVM) and power management module.The main receiver adopts a unified simplified synchronization method and channel codec with proactive Reed-Solomon Bypass technique,which increases the robustness and energy efficiency of receiver.The WUI receiver specifies the communication node and wakes up the transceiver to reduce average power consumption of the transceiver.The embedded NVM can backup/restore the states information of processor that avoids the loss of the state information caused by power failure and reduces the unnecessary power of repetitive computation when the processor is waked up from power down mode.The baseband processor is designed and verified on a FPGA board.The simulated power consumption of processor is 5.1uW for transmitting and 28.2μW for receiving.The WUI receiver technique reduces the average power consumption of transceiver remarkably.If the transceiver operates 30 seconds in every 15 minutes,the average power consumption of the transceiver can be reduced by two orders of magnitude.The NVM avoids the loss of the state information caused by power failure and energy waste caused by repetitive computation. 展开更多
关键词 LR-WPAN wake-up identification receiver synchronization non-volatile memory baseband processor digital integrated circuit low power chip design
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Trends of Communication Processors
2
作者 LIU Dake CAI Zhaoyun WANG Wei 《China Communications》 SCIE CSCD 2016年第1期1-16,共16页
Processors have been playing important roles in both communication infrastructure systems and terminals.In this paper,both application specific and general purpose processors for communications are discussed including... Processors have been playing important roles in both communication infrastructure systems and terminals.In this paper,both application specific and general purpose processors for communications are discussed including the roles,the history,the current situations,and the trends.One trend is that ASIPs(Application Specific Instruction-set Processors) are taking over ASICs(Application Specific Integrated Circuits) because of the increasing needs both on performance and compatibility of multi-modes.The trend opened opportunities for researchers crossing the boundary between communications and computer architecture.Another trend is the serverlization,i.e.,more infrastructure equipments are replaced by servers.The trend opened opportunities for researchers working towards high performance computing for communication,such as research on communication algorithm kernels and real time programming methods on servers. 展开更多
关键词 ASIP baseband processor network processor application processor server processor
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一种基于射频电子标签的超低电压低功耗基带处理器 被引量:13
3
作者 何艳 胡建赟 闵昊 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2006年第10期1866-1871,共6页
设计了一款应用于超高频段射频识别系统中电子标签的超低电压低功耗基带处理器.该基带处理器兼容《EPCTMClass-1Generation-2UHFRFID》协议,并满足无源标签的超低功耗要求.在设计上有针对性地提出了一种适合于门控时钟电源管理机制的体... 设计了一款应用于超高频段射频识别系统中电子标签的超低电压低功耗基带处理器.该基带处理器兼容《EPCTMClass-1Generation-2UHFRFID》协议,并满足无源标签的超低功耗要求.在设计上有针对性地提出了一种适合于门控时钟电源管理机制的体系结构,以及简单有效的随机数发生机制和分布式译码电路;并灵活运用了流水线结构、降低逻辑深度等低功耗技术.实现了解码/编码、CRC校验、指令解析、防碰撞机制和权限认证,以及对EEPROM的读写操作等功能.芯片采用Chartered0·35μm1P3MCMOS标准工艺实现,正常工作的最低电压仅为1·5V,平均电流2·1μA,功耗3·15μW,面积1·1mm×0·8mm. 展开更多
关键词 射频识别 电子标签 基带处理器 低功耗 瞬时功耗
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ZigBee网络节点基带处理器的设计与实现 被引量:10
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作者 施汝杰 高佩君 +1 位作者 田佳音 闵昊 《计算机工程》 CAS CSCD 北大核心 2008年第17期219-221,共3页
设计一款新型符合ZigBee协议的无线传感器网络节点基带处理器。提出一种O-QPSK非相干解调的同步相关解码方式,解决了解调电路的结构冗余问题,降低了数字接收机的信噪比。设计收发控制器完成发送与接收流程的管理,通过模式切换和软件平... 设计一款新型符合ZigBee协议的无线传感器网络节点基带处理器。提出一种O-QPSK非相干解调的同步相关解码方式,解决了解调电路的结构冗余问题,降低了数字接收机的信噪比。设计收发控制器完成发送与接收流程的管理,通过模式切换和软件平台的优化降低了整个节点芯片的工作功耗和面积。通过Altera Stratix S80 FPGA平台进行测试验证,结果符合设计要求。 展开更多
关键词 ZIGBEE协议 无线传感器网络 基带处理器
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无源UHF RFID芯片中低功耗基带处理器的设计 被引量:5
5
作者 毛伟 文光俊 朱学勇 《微电子学》 CAS CSCD 北大核心 2011年第3期346-349,共4页
对UHF RFID标签芯片的数字基带处理器结构及工作原理进行了分析。该基带处理器兼容ISO18000-6C协议。采用一系列先进的低功耗技术,如门控时钟技术、减小工作电压、降低时钟频率等,以降低无源射频识别标签的功耗。整个标签芯片采用TSMC 0... 对UHF RFID标签芯片的数字基带处理器结构及工作原理进行了分析。该基带处理器兼容ISO18000-6C协议。采用一系列先进的低功耗技术,如门控时钟技术、减小工作电压、降低时钟频率等,以降低无源射频识别标签的功耗。整个标签芯片采用TSMC 0.18μm 1P5M嵌入式EEPROM混合CMOS工艺实现。测试结果表明,该芯片正常工作的最低电压仅为1 V,平均电流为6.8μA,功耗为6.8μW,面积仅为150μm×690μm。 展开更多
关键词 超高频 RFID 基带处理器 ISO18000-6C
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满足链路时序的RFID低功耗基带处理器 被引量:2
6
作者 靳钊 庄奕琪 +2 位作者 乔丽萍 刘伟峰 肖磊 《电子测量与仪器学报》 CSCD 2011年第4期355-359,共5页
提出了一种满足EPCglobal Gen2协议对链路时序规定的射频识别(RFID)标签芯片低功耗数字基带处理器的设计。该设计将全局时钟设定为反向散射频率(BLF)的二倍频率2BLF,建立基带数据处理时间和BLF的关系;并采用门控时钟、行波计数器及状态... 提出了一种满足EPCglobal Gen2协议对链路时序规定的射频识别(RFID)标签芯片低功耗数字基带处理器的设计。该设计将全局时钟设定为反向散射频率(BLF)的二倍频率2BLF,建立基带数据处理时间和BLF的关系;并采用门控时钟、行波计数器及状态编码等技术降低基带处理器功耗。该芯片经TSMC 0.18μm RF工艺流片验证,实测结果表明,提出的基带处理器完全满足协议中关于链路时序的要求,功耗降低了22.46%,面积减少了18.03%,标签识别速率最高为96.3次/s,识别距离可达6.8 m。 展开更多
关键词 射频识别 基带处理器 低功耗 链路时序
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基于CMX910的AIS基带处理模块的设计与应用 被引量:2
7
作者 姚元飞 佟力 谢永锋 《电讯技术》 2008年第5期82-85,共4页
介绍了基于CMX910的AIS基带处理模块的设计思想和方法,以及工程应用的实现。该设计方法与传统的DSP、FPGA设计方法相比,大大降低了量产难度,也使AIS设备的接收灵敏度、接收频偏、矢量信号误差等性能指标大幅度得到提高,而且在很大程度... 介绍了基于CMX910的AIS基带处理模块的设计思想和方法,以及工程应用的实现。该设计方法与传统的DSP、FPGA设计方法相比,大大降低了量产难度,也使AIS设备的接收灵敏度、接收频偏、矢量信号误差等性能指标大幅度得到提高,而且在很大程度上降低了AIS设备的成本。目前该设计已经成功地在AIS中得到应用。 展开更多
关键词 自动识别系统 CMX910芯片 ARM芯片 基带处理模块 设计 应用
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移动终端管控系统基带板卡硬件设计与实现 被引量:1
8
作者 王宁 田增山 +1 位作者 刘宇 施华雷 《电视技术》 北大核心 2013年第9期52-55,94,共5页
移动终端管控系统是一种关联紧密的多通道信号处理系统,基带板卡是其有效保障。给出了一种DSP+ARM+FPGA多通道基带板卡设计方案,进行基带板卡硬件架构、功能和技术需求设计,对系统硬件电路进行详细设计和实现。通过测试验证了硬件设计... 移动终端管控系统是一种关联紧密的多通道信号处理系统,基带板卡是其有效保障。给出了一种DSP+ARM+FPGA多通道基带板卡设计方案,进行基带板卡硬件架构、功能和技术需求设计,对系统硬件电路进行详细设计和实现。通过测试验证了硬件设计的可行性。 展开更多
关键词 移动终端管控 FPGA DSP ARM 基带处理 测试
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基于嵌入式处理器软核的DVB-S基带处理系统 被引量:5
9
作者 杨浩 林争辉 +1 位作者 鞠海 蔡雄飞 《计算机工程》 EI CAS CSCD 北大核心 2005年第6期203-205,F003,共4页
完整地给出了一种利用SoPC策略在大规模FPGA上实现高度集成的DVB-S前端基带处理系统的SoC实现。从系统模型设计入手,综合运用了集成电路和SoC设计手段设计验证了基带处理IP,并整合了嵌入式处理器(Nios)软核及其应用程序,极大地提高了系... 完整地给出了一种利用SoPC策略在大规模FPGA上实现高度集成的DVB-S前端基带处理系统的SoC实现。从系统模型设计入手,综合运用了集成电路和SoC设计手段设计验证了基带处理IP,并整合了嵌入式处理器(Nios)软核及其应用程序,极大地提高了系统性能并降低了总体成本。还提出了基于混合层次仿真的设计验证方法。 展开更多
关键词 数字视频广播(DVB) 基带处理 系统级可编程芯片 嵌入式处理器 NIOS 混合层次仿真
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一种基于FPGA的雷达数字信号处理机设计与实现 被引量:5
10
作者 霍志 谢启友 +1 位作者 郭靖 刁节涛 《现代电子技术》 2012年第1期13-16,共4页
结合具体的雷达导引头型号项目,从数字信号处理机的原理出发,根据项目的要求提出了一种基于DBF技术的某型导引头信号处理机设计方案,方案以Xilinx公司Virtex4SX55FPGA作为数字信号处理的核心器件,实现对6阵元阵列天线接收的回波信号进... 结合具体的雷达导引头型号项目,从数字信号处理机的原理出发,根据项目的要求提出了一种基于DBF技术的某型导引头信号处理机设计方案,方案以Xilinx公司Virtex4SX55FPGA作为数字信号处理的核心器件,实现对6阵元阵列天线接收的回波信号进行实时采集和处理。对系统硬件和软件总体设计及基频信号产生模块、回波信号采集模块、控制信号产生模块和时钟电路模块的具体设计进行了详细介绍。最后在暗室环境对系统进行了测试,测试结果表明系统达到了设计要求。 展开更多
关键词 数字信号处理机 FPGA DBF 基频信号 回波信号
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SoPC技术及其在DVB-S基带处理系统中的应用 被引量:4
11
作者 鞠海 林争辉 葛亮 《电视技术》 北大核心 2004年第1期28-30,66,共4页
介绍了基于大规模FPGA和嵌入式处理器的SoPC(SystemonaProgrammableChip系统级可编程芯片)设计技术,并结合DVB-S前端基带处理系统单芯片的设计过程,综合运用了一系列集成电路和SoC设计手段,给出了完整的SoPC设计流程、方法以及关键技术。
关键词 SOPC DVB—S 基带处理 FPGA 嵌入式处理器 系统级可编程芯片 数字视频广播
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面向海关应用的UHF RFID电子标签芯片基带处理器
12
作者 陈健 文光俊 +1 位作者 冯筱 谢良波 《微电子学》 CAS CSCD 北大核心 2012年第3期388-392,共5页
设计了一款基于ISO 18000-6C协议且适用于海关集装箱运输监控的数字基带处理器。提出并分析了数字基带处理器的总体结构以及模块划分,详细介绍了锁离合采集、锁离合监测记录等关键电路的设计。芯片采用TSMC 0.18μm 1P5M嵌入式EEPROM混... 设计了一款基于ISO 18000-6C协议且适用于海关集装箱运输监控的数字基带处理器。提出并分析了数字基带处理器的总体结构以及模块划分,详细介绍了锁离合采集、锁离合监测记录等关键电路的设计。芯片采用TSMC 0.18μm 1P5M嵌入式EEPROM混合CMOS工艺实现。测试结果表明,芯片支持协议规定的所有功能,能正确记录开锁次数,其正常工作的最低电压为1V,平均电流为6.7μA,功耗为6.7μW,芯片尺寸为710μm×320μm。 展开更多
关键词 射频识别 电子标签 基带处理器 锁离合
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低频电子标签基带处理器的设计与实现
13
作者 田佳音 何艳 +1 位作者 施汝杰 闵昊 《计算机工程》 CAS CSCD 北大核心 2008年第14期231-233,共3页
设计一款新型低频电子标签基带处理器,提出一种新颖的异步解码机制,解决了100%振幅键控调制模式下时钟中断的问题,利用指令头解析与片选信号相结合的指令解析机制,提高了指令解析速度,并综合应用能量管理、结构优化等多种低功耗设计方... 设计一款新型低频电子标签基带处理器,提出一种新颖的异步解码机制,解决了100%振幅键控调制模式下时钟中断的问题,利用指令头解析与片选信号相结合的指令解析机制,提高了指令解析速度,并综合应用能量管理、结构优化等多种低功耗设计方法提高电子标签响应速度和抗干扰能力,降低芯片功耗与面积。该芯片采用SMIC 0.18 μm 2P4M标准CMOS工艺实现。与国外同类芯片相比,该设计以较小的面积与功耗实现了更高的性能。 展开更多
关键词 射频识别 低频电子标签 基带处理器
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基于芯片的手机增强技术发展趋势分析 被引量:3
14
作者 詹文浩 戴国华 《移动通信》 2016年第11期7-11,共5页
为了分析手机增强技术的发展趋势,以手机芯片作为分析的基础,通过研究手机芯片的现状和发展趋势,探讨了手机内应用处理器、基带芯片、射频芯片各自的市场和技术前景,并总结出增强技术在手机中的实际支持情况。通过分析得知,应用处理器... 为了分析手机增强技术的发展趋势,以手机芯片作为分析的基础,通过研究手机芯片的现状和发展趋势,探讨了手机内应用处理器、基带芯片、射频芯片各自的市场和技术前景,并总结出增强技术在手机中的实际支持情况。通过分析得知,应用处理器、基带芯片、射频芯片的发展使手机具备更强的与外界相连的能力,高清语音、视频对话等业务也得到了更强力的支持。 展开更多
关键词 手机芯片 应用处理器 基带芯片 射频芯片
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一种零值测试基带信号源设计
15
作者 徐茜 宫海波 《计算机测量与控制》 2019年第4期263-266,270,共5页
北斗是我国自主研发并独立运行的全球卫星导航系统,为了解决北斗导航系统的基带信号调试处理难题,提出了一种零值测试基带信号源设计方案;针对导航系统信号通道多、信号传输速率高且时钟信号精度要求高的特点,单板上集成高性能FPGA和DS... 北斗是我国自主研发并独立运行的全球卫星导航系统,为了解决北斗导航系统的基带信号调试处理难题,提出了一种零值测试基带信号源设计方案;针对导航系统信号通道多、信号传输速率高且时钟信号精度要求高的特点,单板上集成高性能FPGA和DSP处理器,系统采用模块化设计,采用直接数字射频信号发射技术及高速时钟系统设计,信号源可模拟并输出多制式多路调制基带信号,可完成4通道射频信号采集以及4通道直接射频信号的产生,可灵活配置工作参数及设备工作状态的实时监测;该信号源在北斗导航系统的研发过程中获得成功应用,实验结果表明,该信号源兼备收发两大信号处理链路功能,系统具有通用性强、配置灵活、稳定性好等特点,解决了导航系统领域基带信号调试处理难题。 展开更多
关键词 导航 处理器 零值测试 基带 信号源
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低功耗UHFRFID标签基带处理器的ASIC实现(英文) 被引量:3
16
作者 朱秋玲 张春 +3 位作者 王晓辉 刘忠奇 李永明 王志华 《半导体技术》 CAS CSCD 北大核心 2009年第2期172-176,共5页
设计并实现了一种新颖的超高频RFID标签的基带处理器。该标签以ISO/IEC 18000-6C协议为基础,但在反向链路通信方面,在原协议FM0编码/Miller调制副载波的基础上增加了扩频编码的实现,目的是提高反向链路的通信信噪比。该设计支持协议要... 设计并实现了一种新颖的超高频RFID标签的基带处理器。该标签以ISO/IEC 18000-6C协议为基础,但在反向链路通信方面,在原协议FM0编码/Miller调制副载波的基础上增加了扩频编码的实现,目的是提高反向链路的通信信噪比。该设计支持协议要求的所有11条强制命令的读写操作,概率/分槽防冲突算法,以及对存储器的读写操作。设计中采用了低功耗技术,显著降低了芯片的平均功耗和峰值功耗。芯片采用0.18μm 6层金属CMOS工艺进行流片,面积为0.5 mm2。测试结果表明,芯片消耗功耗约为16μW,最低工作电压为1.04 V。 展开更多
关键词 RFID标签 基带处理器 低功耗 扩频
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超高频RFID标签数字基带处理器的设计 被引量:2
17
作者 吴殿丞 杨骅 +2 位作者 张铁军 王东辉 侯朝焕 《微电子学与计算机》 CSCD 北大核心 2010年第9期1-4,共4页
针对超高频RFID标签芯片小面积、低功耗的要求,设计了一种符合EPC C1G2标准的数字基带处理器.在分析其功能基础上进行模块划分,提出了一种新的体系结构;论述并推导了标签工作所需的最低频率;设计了功耗管理模块,在降低功耗的同时,通过... 针对超高频RFID标签芯片小面积、低功耗的要求,设计了一种符合EPC C1G2标准的数字基带处理器.在分析其功能基础上进行模块划分,提出了一种新的体系结构;论述并推导了标签工作所需的最低频率;设计了功耗管理模块,在降低功耗的同时,通过调度各个模块,使其正确地协同工作;采用流水线方式进行编码输出;简化了存储器接口的设计.仿真结果符合标准要求,综合后电路规模约7 200门.该电路可应用于超高频RFID标签. 展开更多
关键词 射频识别 电子标签 基带处理器 EPC
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UHF RFID标签基带处理器的低功耗设计 被引量:2
18
作者 王晓晖 张春 +2 位作者 马长明 吴行军 朱秋玲 《半导体技术》 CAS CSCD 北大核心 2009年第5期502-505,518,共5页
随着超高频RFID标签的应用越来越广泛,在提高其性能上的需求也越来越迫切。对于无源标签,工作距离是一个非常重要的指标。要提高工作距离,就要降低标签的功耗。着重从降低功耗方面阐述了一款基于ISO18000-6TypeC协议的UHF RFID标签基带... 随着超高频RFID标签的应用越来越广泛,在提高其性能上的需求也越来越迫切。对于无源标签,工作距离是一个非常重要的指标。要提高工作距离,就要降低标签的功耗。着重从降低功耗方面阐述了一款基于ISO18000-6TypeC协议的UHF RFID标签基带处理器的设计。简要介绍了设计的结构,详细阐述了各种低功耗设计技术,如动态控制时钟频率、寄存器复用、使用计数器和组合逻辑代替移位寄存器、异步计数器、门控时钟等的应用。结果证明,这些措施有效地降低了功耗,仿真结果为在工作电压为1V,时钟为2.5MHz时,功耗为4.8μW;目前实现了前三项措施的流片,测试结果表明工作电压为1V,时钟为2.5MHz时,功耗为8.03μW。 展开更多
关键词 射频识别 超高频 ISO/IEC18000-6 Type C标准 标签 基带处理器 低功耗
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基于ANTARIS 4芯片组的GPS模块设计
19
作者 杨书杰 张金龙 《工业控制计算机》 2008年第9期94-95,共2页
GPS模块由天线输入、低噪声放大器、滤波器、射频处理单元和基带处理单元等组成,介绍了基于ANTARIS 4芯片组的GPS模块的参考设计,对每个单元的设计作了说明,给出了硬件设计方案,阐述了射频与数字混合的PCB板设计方案。经测试模块性能达... GPS模块由天线输入、低噪声放大器、滤波器、射频处理单元和基带处理单元等组成,介绍了基于ANTARIS 4芯片组的GPS模块的参考设计,对每个单元的设计作了说明,给出了硬件设计方案,阐述了射频与数字混合的PCB板设计方案。经测试模块性能达到-158dBm的高灵敏度。模块具有低功耗、极小尺寸等特点,是专门为移动等领域的应用而设计的。 展开更多
关键词 全球定位系统 低噪声放大器 射频前端 变频器 基带处理器
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UHF RFID标签基带处理器的ASIC设计 被引量:2
20
作者 乔文 冯全源 《微电子学》 CAS CSCD 北大核心 2012年第2期164-167,172,共5页
提出了一款基于EPC Class1 Generation2协议的UHF RFID标签基带处理器。考虑到工作距离是无源标签的一个重要指标,要提高工作距离,就要降低标签功耗,采取了一系列低功耗措施,如2.56MHz和1.28MHz的双时钟策略、增加单元开关功能以及使用... 提出了一款基于EPC Class1 Generation2协议的UHF RFID标签基带处理器。考虑到工作距离是无源标签的一个重要指标,要提高工作距离,就要降低标签功耗,采取了一系列低功耗措施,如2.56MHz和1.28MHz的双时钟策略、增加单元开关功能以及使用异步计数器等。设计采用TSMC 0.18μm工艺,工作电压为1.8V,功耗为6.4μW,版图尺寸为415μm×398μm。采用Xilinx的FPGA开发平台进行验证,测试结果满足C1G2协议要求。 展开更多
关键词 射频识别 标签 基带处理器 EPC Class1 Generation2协议
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