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一种基于DDS和PLL技术本振源的设计与实现 被引量:14
1
作者 任鹏 周资伟 朱江 《现代电子技术》 2009年第9期178-180,共3页
现代频率合成技术正朝着高性能、小型化的方向发展,应用最为广泛的是直接数字式频率合成器(DDS)和锁相式频率合成器(PLL)。介绍直接数字频率合成器和锁相环频率合成器的基本原理,简述用直接数字频率合成器(AD9954)和锁相环频率合成器(AD... 现代频率合成技术正朝着高性能、小型化的方向发展,应用最为广泛的是直接数字式频率合成器(DDS)和锁相式频率合成器(PLL)。介绍直接数字频率合成器和锁相环频率合成器的基本原理,简述用直接数字频率合成器(AD9954)和锁相环频率合成器(ADF4112)所设计的本振源的实现方案,重点阐述了系统的硬件实现,包括系统原理、主要电路单元设计等,并且对系统的相位噪声和杂散性能做了简要分析,最后给出了系统测试结果。 展开更多
关键词 DDS pll 频率合成器 本振源
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一种DDS/PLL混合型高分辨率频率合成器 被引量:7
2
作者 王建新 刘国岁 朱伟强 《电子测量与仪器学报》 CSCD 1999年第4期72-75,共4页
本文利用直接数字频率合成器频率分辨率高和相位噪声低而锁相环频率合成器输出频率高和对鉴相输入呈现窄带特性的优点,用STEL一1175DDS芯片设计了一个高分辨率正弦信号产生器,并以此推动锁相环进行倍频。通过这种 DDS... 本文利用直接数字频率合成器频率分辨率高和相位噪声低而锁相环频率合成器输出频率高和对鉴相输入呈现窄带特性的优点,用STEL一1175DDS芯片设计了一个高分辨率正弦信号产生器,并以此推动锁相环进行倍频。通过这种 DDS/PLL混合型频率合成器,得到了中心频率为 38MHz的高分辨率正弦信号。本文给出了电路设计过程及测试结果。 展开更多
关键词 锁相环 频率合成器 DDFS 混合型 正弦信号
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基于FPGA数字PLL谐振频率的跟踪研究 被引量:7
3
作者 余成波 张林 龙曦 《重庆理工大学学报(自然科学)》 CAS 北大核心 2019年第4期141-146,共6页
针对谐振频率漂移造成无线电能传输系统(MCR-WPT)传输效率低下的问题,提出一种自适应全数字锁相环的频率跟踪控制方法。采用FPGA实现的数字锁相环(PLL)跟踪发射线圈电流电压相位信号,确保发射线圈处于谐振工作状态。设计了数字锁相环的... 针对谐振频率漂移造成无线电能传输系统(MCR-WPT)传输效率低下的问题,提出一种自适应全数字锁相环的频率跟踪控制方法。采用FPGA实现的数字锁相环(PLL)跟踪发射线圈电流电压相位信号,确保发射线圈处于谐振工作状态。设计了数字锁相环的鉴相器模块、2阶环路滤波器模块以及数控振荡器模块。利用ModelSim对数字锁相环的跟踪性能进行仿真测试,得出环路增益、环路带宽对跟踪性能的影响。研制了数字PLL控制的小功率MCR-WPT系统。实验结果表明:在增益为35 Hz、初始频差小于50 Hz的情况下,电流电压信号稳态相差为零,该方法在谐振频率漂移时能完成对频率的快速跟踪,有效地提高了MCR-WPT传输效率和传输功率。 展开更多
关键词 数字锁相环 FPGA 无线电能
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基于MPU/PLL和CPLD技术的数字正弦信号发生器的设计与分析 被引量:5
4
作者 刘进志 陈涤 《山东大学学报(理学版)》 CAS CSCD 北大核心 2005年第5期88-92,共5页
直接数字波形合成式正弦波发生器,对于提高多功能校验仪的稳定性和准确度具有基础性意义.研究了基于微处理器(micro processor unit,MPU)、锁相环(phaselockedloop,PLL)和复杂可编程逻辑器件(complicated programmable logicdevice,CPLD... 直接数字波形合成式正弦波发生器,对于提高多功能校验仪的稳定性和准确度具有基础性意义.研究了基于微处理器(micro processor unit,MPU)、锁相环(phaselockedloop,PLL)和复杂可编程逻辑器件(complicated programmable logicdevice,CPLD)技术的高精度,可调频、调相、调幅的双路数字合成正弦波发生器的设计方案.给出了调频、调相、调幅的实现方法和对设计要点的相关分析. 展开更多
关键词 直接数字合成 正弦波发生器 微控制器 锁相环 复杂可编程逻辑器件
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混合信号集成电路数字PLL衬底噪声的SPICE模拟及分析 被引量:3
5
作者 师奕兵 陈光 +1 位作者 王厚军 Jiann S.Yuan 《电子科技大学学报》 EI CAS CSCD 北大核心 2000年第3期273-277,共5页
应用PSPICE及采用C语言自编的外部程序,对单片数字锁相环电路中的衬底噪声及对电路性能的影响进行了模拟研究和分析,有助于进一步理解衬底噪声及衬底噪声对复杂的混合信号电路工作的影响,提出了实际应用中选择衬底类型的方法。
关键词 混合信号集成电路 衬底噪声 数字锁相环 SPICE模
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一种基于DDS和PLL的Chirp超宽带信号源设计与实现 被引量:2
6
作者 刘健余 林基明 +2 位作者 樊孝明 章兴良 徐兴华 《重庆邮电大学学报(自然科学版)》 北大核心 2011年第1期65-70,共6页
Chirp超宽带具有峰值平均功率比(peak to average power ratio,PAPR)接近为1、测距定位能力强等优势,能够有效解决传统的超宽带技术存在的PAPR过大、传输距离短等问题,设计并产生Chirp超宽带信号是实现该通信系统的关键技术之一。提出... Chirp超宽带具有峰值平均功率比(peak to average power ratio,PAPR)接近为1、测距定位能力强等优势,能够有效解决传统的超宽带技术存在的PAPR过大、传输距离短等问题,设计并产生Chirp超宽带信号是实现该通信系统的关键技术之一。提出了一种高性能Chirp超宽带信号源方案,通过采用现场可编程门阵列(field-programma-ble gate array,FPGA)控制直接数字频率合成(direct digital synthesis,DDS)芯片AD9956产生低频Chirp信号,并结合锁相环(phase locked loop,PLL)技术实现带宽扩展,从而获得Chirp超宽带信号。实验表明,所设计的Chirp超宽带信号源具有结构简单、可编程、可扩展、性能好及实用性强等优点。 展开更多
关键词 超宽带 CHIRP信号 直接数字频率合成(DDS) 锁相环(pll)
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DDS+PLL组合系统及实例 被引量:14
7
作者 杨建军 《电讯技术》 北大核心 2001年第1期72-75,共4页
本文介绍了DDS +PLL系统的实现方案和特点 ,指出了设计DDS +PLL系统的注意事项 ,并通过实例证明DDS +PLL系统能够实现较高的频谱质量 ,具有一定的实用价值。
关键词 频率全盛 锁相环 直接数字合成
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DDS激励PLL频率合成器的研究 被引量:2
8
作者 唐巍 刘文贵 张乃通 《遥测遥控》 1999年第2期43-47,共5页
频率合成器是现代通信设备的重要组成部分。首先介绍频率合成技术,然后分析了倍频式DDS激励PLL频率合成器的噪声性能。
关键词 ^+直接数字频率合成 ^+锁相频率合成 ^+DDS激励pll 噪音
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采用DDS+PLL技术实现数字式信号源 被引量:1
9
作者 管小明 吴邦国 谢新虎 《科技广场》 2007年第9期217-218,共2页
目前实验室常用的信号源一般都是用模拟电路来产生所需的信号。模拟信号有着显示不直观、输出不稳定、低频信号差等缺点。本文介绍一种采用DDS+PLL技术来实现数字式信号源的基本方法和原理,设计电路提供了数字式的直接输入,操作简单、... 目前实验室常用的信号源一般都是用模拟电路来产生所需的信号。模拟信号有着显示不直观、输出不稳定、低频信号差等缺点。本文介绍一种采用DDS+PLL技术来实现数字式信号源的基本方法和原理,设计电路提供了数字式的直接输入,操作简单、显示直观,以满足实验室的实际需要。 展开更多
关键词 锁相环 DDS 数字式 信号源
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AV系统数字调谐PLL频率合成器的单片机控制
10
作者 于春利 杨林安 《微电子学与计算机》 CSCD 北大核心 2002年第1期38-39,43,共3页
文章利用LC7218PLL频率合成器在AV领域的电调谐功能,提出了一个TV/FM/AM全景接收机设计方案,重点设计分析了LC7218与单片机之间的I/O数据结构,显示了它优良的性能。
关键词 频率合成器 单片机控制 AV系统 数字调谐 pll
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通信系统中锁相调频(PLL—FM)电路特性的研究
11
作者 陈殿仁 加纳晴已 真野国夫 《长春光学精密机械学院学报》 1993年第4期24-27,共4页
本文在线性近似的条件下,对锁相调频(PpLL—FM)电路进行了理论分析和实验研究。计算并测试出该系统在通信过程中的过渡特性和调制特性。
关键词 锁相调频电路 数据通信 通信系统
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基于DDS与PLL的C波段宽带线性扫频源 被引量:4
12
作者 刘志强 沈亚飞 +1 位作者 王文博 徐金平 《微波学报》 CSCD 北大核心 2018年第4期71-76,共6页
利用直接数字频率合成(DDS)和锁相环(PLL)技术相结合的混合频率合成方案,研制了一种C波段宽带、高频率分辨率、快速线性扫频的频率源。为了给PLL提供低相位噪声的宽带扫频参考信号,选用ADI的DDS芯片AD9914,并利用阶跃恢复二极管(SR... 利用直接数字频率合成(DDS)和锁相环(PLL)技术相结合的混合频率合成方案,研制了一种C波段宽带、高频率分辨率、快速线性扫频的频率源。为了给PLL提供低相位噪声的宽带扫频参考信号,选用ADI的DDS芯片AD9914,并利用阶跃恢复二极管(SRD)高次倍频电路结合二倍频器产生高达3400 MHz的时钟信号。通过上位机配置AD9914内部频率调谐字和数字斜坡发生器,产生512.5-987.5 MHz的扫频参考信号,其频率分辨率可精细到赫兹量级。选用低附加噪声的鉴相器和宽带VCO芯片设计C波段锁相源,在宽带工作频率范围内对DDS扫频信号进行快速跟踪,并有效抑制杂散信号。实测结果表明,该扫频源工作频率为4.1-7.9 GHz,在频率分辨率配置为0.38 MHz时,单向扫频周期为1 ms,扫频线性度为1.58×10-6。单频点输出时相位噪声优于-114 dBc/Hz@10 kHz和-119 dBc/Hz@100 kHz,杂散抑制优于69 dBc。 展开更多
关键词 直接数字频率合成 锁相环 宽带扫频源 低相位噪声 倍频链
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基于DDS和PLL的宽带时钟发生电路设计 被引量:1
13
作者 郭广坤 田书林 刘科 《自动化信息》 2009年第10期36-37,40,共3页
针对高速任意波形发生器对高精度、宽带时钟电路的需要,提出了一种通过DDS加PLL的可变时钟设计方法。对DDS参数的选择、锁相环倍数的选择进行了详细分析,并对相位噪声的指标分配进行了论证,最后给出了输出频率范围为200MHz-1.25GHz... 针对高速任意波形发生器对高精度、宽带时钟电路的需要,提出了一种通过DDS加PLL的可变时钟设计方法。对DDS参数的选择、锁相环倍数的选择进行了详细分析,并对相位噪声的指标分配进行了论证,最后给出了输出频率范围为200MHz-1.25GHz的时钟电路的设计方案。通过实验验证,证明了上述分析的正确性。 展开更多
关键词 相位噪声 锁相环 DDS 可变时钟
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Low spurious noise frequency synthesis based on a DDS-driven wideband PLL architecture 被引量:1
14
作者 王宏宇 王昊飞 +1 位作者 任丽香 毛二可 《Journal of Beijing Institute of Technology》 EI CAS 2013年第4期514-518,共5页
An S-band frequency synthesizer for a stepped-frequency radar is presented. This frequen- cy synthesizer is based on a direct digital synthesizer ( DDS ) -driven wideband phase-locked loop (PLL) architecture which... An S-band frequency synthesizer for a stepped-frequency radar is presented. This frequen- cy synthesizer is based on a direct digital synthesizer ( DDS ) -driven wideband phase-locked loop (PLL) architecture which can achieve low spurious noise and rapid frequency hopping simultaneous- ly. The mechanism of introducing high level spurs by the images of DDS digital to analog convertor (DAC) output is analyzed. A novel DDS frequency planning method is proposed to ensure low col- ored noise within the entire bandwidth. The designed output frequency range is 3. 765 -4. 085 GHz, and the step size is 5 MHz with frequency agility of less than 1 μs. Measured results demonstrate that the average spurious free dynamic range (SFDR) is about 64 dBc in a 320 MHz bandwidth. 展开更多
关键词 direct digital synthesizer (DDS) phase-locked loop pll spurious components
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检测PLL稳定的方法
15
作者 杨卫平 《无线互联科技》 2018年第7期114-115,共2页
文章讨论本发明创造的发明点在于:用全数字设计的方法,简洁、准确地判断PLL是否处于稳定状态,经研究,发现其特别适用于全数字PLL。
关键词 pll 锁定 稳定 全数字
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基于DSP的高精度UPS锁相技术 被引量:11
16
作者 皮大能 马学军 +1 位作者 南光群 康勇 《电力电子技术》 CSCD 北大核心 2005年第5期109-111,共3页
为了保证UPS由逆变输出转市电旁路时的可靠切换,其输出电压和电网电压的频率、相位应时刻保持一致。本文针对全数字化控制的UPS系统,结合锁相环原理,研究了利用TMS320F240型DSP实现高精度锁相的数字锁相环原理与实现方法。该方法利用DS... 为了保证UPS由逆变输出转市电旁路时的可靠切换,其输出电压和电网电压的频率、相位应时刻保持一致。本文针对全数字化控制的UPS系统,结合锁相环原理,研究了利用TMS320F240型DSP实现高精度锁相的数字锁相环原理与实现方法。该方法利用DSP的捕获中断和周期中断读取市电和逆变输出的相位差,经PI调节器输出一个载波周期的补偿量,通过动态改变载波周期值实现逆变输出对市电的动态跟踪,理论上相位差分辨率可高达0.72°。文中给出了硬件实现电路及程序流程图。实验结果验证了该方案的可行性和有效性。 展开更多
关键词 不问断电源 数字技术/锁相环 数字信号处理器
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基于DSP带同步锁相的逆变器控制 被引量:24
17
作者 林征宇 吴建德 何湘宁 《电力电子技术》 CSCD 北大核心 2001年第2期24-25,28,共3页
针对电源冗余设计 ,采用数字控制的方法 ,用数字信号处理器 (DSP)TMS32 0F2 4X设计并实现了带同步锁相的单相电压型逆变器控制方案。
关键词 逆变器 数字控制 同步锁相 DSP 数字信号处理器
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高频数字锁相环的研究 被引量:8
18
作者 何松柏 鲍景富 曾学刚 《电讯技术》 北大核心 1997年第2期26-29,共4页
】论文阐述了100MHz数字锁相环的设计过程。用10MHz晶体振荡器对100MHz数字压控振荡器进行锁相,使100MHz输出信号指标得到很大改善。论文还分析了各单元电路,关键点时域波形测试。
关键词 信号源 数字锁相环 压控振荡器 高频电路
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锁相环中数字分频器对输出信号相位噪声和杂散的影响 被引量:4
19
作者 王春晖 金小军 +2 位作者 金仲和 郑阳明 赵翔宇 《宇航学报》 EI CAS CSCD 北大核心 2009年第6期2334-2338,2397,共6页
基于对数字分频器混叠效应的分析,解释了锁相环相位噪声线形模型与一些实验结果误差较大的原因。并通过对数字分频器的建模,得到了数字分频器输出信号相位噪声和杂散的计算方法。实验证明这种方法的计算结果与实验结果相吻合。再以此修... 基于对数字分频器混叠效应的分析,解释了锁相环相位噪声线形模型与一些实验结果误差较大的原因。并通过对数字分频器的建模,得到了数字分频器输出信号相位噪声和杂散的计算方法。实验证明这种方法的计算结果与实验结果相吻合。再以此修正锁相环相位噪声线形模型,使锁相环输出信号的相位噪声和杂散的预测能够更加准确。 展开更多
关键词 锁相环 数字分频器 相位噪声 杂散
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基波相位和频率的高精度检测及在有源电力滤波器中的应用 被引量:21
20
作者 周卫平 吴正国 夏立 《中国电机工程学报》 EI CSCD 北大核心 2004年第4期91-96,共6页
该文提出了一种电力基波频率和相位的高精度数字化实时检测方法,提出了基于高精度基波相频实时检测的有源电力滤波器谐波和无功电流的检测方法。相位检测是基于三角函数正交性及自适应滤波的原理构造了相位跟踪的闭环控制回路,结合延时... 该文提出了一种电力基波频率和相位的高精度数字化实时检测方法,提出了基于高精度基波相频实时检测的有源电力滤波器谐波和无功电流的检测方法。相位检测是基于三角函数正交性及自适应滤波的原理构造了相位跟踪的闭环控制回路,结合延时反馈及变参数 PI 控制技术,使初相跟踪检测的精度达到(10-4)o^(10-10)o的数量级;基波频率的测量是基于初相跟踪检测控制系统的基础之上,求取稳态时初相修正量的时间变化率,即可作为频率跟踪的反馈。在有源电力滤波器中,利用该方法可以求取电压和电流的基波相位频率和相应基波的单位正弦函数,基波幅值用滑窗傅立叶变换的方法求得,从而方便精确地检测出有功和谐波电流。仿真与实验结果证明了所提方法的正确性和有效性。 展开更多
关键词 有源电力滤波器 基波相位 频率 检测 电力系统 无功功率补偿
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