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一种基于Serial RapidIO标准协议的高速交换技术 被引量:7
1
作者 朱新忠 王冠雄 +2 位作者 韦杰 鲍迪 李毅 《航天标准化》 2020年第2期8-11,共4页
为解决空间信息系统在大数据吞吐场景下传输带宽有限、架构互联性较差的问题,文章分析Serial RapidIO(SRIO)高速串行总线交换技术特点,结合SpaceVPX架构研究一种交换阵列,以此为基础构建了SRIO交换模块,并基于IBIS-AMI模型验证了信号完... 为解决空间信息系统在大数据吞吐场景下传输带宽有限、架构互联性较差的问题,文章分析Serial RapidIO(SRIO)高速串行总线交换技术特点,结合SpaceVPX架构研究一种交换阵列,以此为基础构建了SRIO交换模块,并基于IBIS-AMI模型验证了信号完整性,开展SRIO交换技术验证,单端口速率可达20Gbps,理论吞吐率为440Gbps,可广泛应用于高速网络化信息系统。 展开更多
关键词 serial rapidio(SRIO) 高速交换 CPS1848 标准通信协议
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基于Serial RapidIO的高速实时数据采集处理系统 被引量:3
2
作者 朱坚 徐光辉 朱利利 《电子质量》 2008年第10期6-8,共3页
首先分析了传统共享型总线在高速实时数据采集处理系统中应用的局限性,介绍了新型交换式串行总线的优势。在对比当前流行的四种新型交换式高速串行总线特点的基础上,分析了采用Serial RapidIO技术架构系统的优势,设计了一个基于这一技... 首先分析了传统共享型总线在高速实时数据采集处理系统中应用的局限性,介绍了新型交换式串行总线的优势。在对比当前流行的四种新型交换式高速串行总线特点的基础上,分析了采用Serial RapidIO技术架构系统的优势,设计了一个基于这一技术的高速实时数据采集处理系统。该系统具有易扩展、易升级的特点,具有较高的实际应用价值。 展开更多
关键词 数据采集处理 共享型总线 交换式总线 serial rapidio
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Research on physical layer traffic management schemes in serial RapidIO interconnect 被引量:6
3
作者 ZHANG Yong WANG Yong ZHANG Ping 《The Journal of China Universities of Posts and Telecommunications》 EI CSCD 2011年第1期64-69,共6页
A traffic management scheme in serial RapidlO (SR10) interconnect is proposed to deal with the performance degradation caused by noise and electromagnetic interference (EMI), which is generated by hardly avoidable... A traffic management scheme in serial RapidlO (SR10) interconnect is proposed to deal with the performance degradation caused by noise and electromagnetic interference (EMI), which is generated by hardly avoidable errors of hardware implementation and tough working environment. The main idea of this scheme includes adaptive speed transition and freeze-acknowledgement (freeze-ACK). Adaptive speed transition can improve throughput and reduce delay in high bit error rate (BER) environment. Simultaneously, freeze-ACK is adopted to conquer frequent usage of feedback channel. Simulation shows that the scheme of combining adaptive speed transition with freeze-ACK offers great performance improvement in SRIO network. 展开更多
关键词 serial rapidio traffc management physical layer traffic management adaptive speed transition frecze-ACK
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高速串行总线RapidIO与PCI Express协议分析比较 被引量:10
4
作者 梁小虎 王乐 张亚棣 《航空计算技术》 2010年第3期127-130,共4页
随着新一代嵌入式系统对数据传输能力要求的提高,高速串行总线有着越来越广泛的应用,RapidIO和PCI Express(亦称PCIe)是常见的选择。通过对这两种协议在整体工作机制及其特点、分层模型、拓扑结构、服务质量等方面的分析比较,为嵌入式... 随着新一代嵌入式系统对数据传输能力要求的提高,高速串行总线有着越来越广泛的应用,RapidIO和PCI Express(亦称PCIe)是常见的选择。通过对这两种协议在整体工作机制及其特点、分层模型、拓扑结构、服务质量等方面的分析比较,为嵌入式系统设计中高速串行总线的选择提供参考。 展开更多
关键词 高速串行总线 rapidio PCI-E 服务质量 错误管理
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基于RapidIO的双路IEEE 1394b串行总线控制器的实现 被引量:2
5
作者 梁青 罗金生 《测控技术》 CSCD 北大核心 2013年第5期67-71,共5页
介绍了1394b总线网络系统和1394b逻辑设计架构,阐述了基于RapidIO架构的双路1394总线控制器的硬件平台。在此平台上进行基于VxWorks操作系统的1394驱动开发和RapidIO驱动开发,并搭建1394b总线网路测试平台。验证了板卡上两路1394b总线... 介绍了1394b总线网络系统和1394b逻辑设计架构,阐述了基于RapidIO架构的双路1394总线控制器的硬件平台。在此平台上进行基于VxWorks操作系统的1394驱动开发和RapidIO驱动开发,并搭建1394b总线网路测试平台。验证了板卡上两路1394b总线控制器的基本通信功能,实现了板卡内部芯片间的高速互联,以及根节点和叶节点在不同通道上、在100 Mbit/s和400 Mbit/s速率模式下的总线网路通信。 展开更多
关键词 IEEE 1394b协议 rapidio协议 MPC8641处理器 Tsi578交换机 FPGA
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基于串行RapidIO的通用数字信号处理模块设计 被引量:6
6
作者 吕遵明 王彦刚 《信息化研究》 2009年第9期39-41,共3页
随着通信技术发展,要求平台的处理能力越来越高,同时器件间数据交互量也急剧增多,传统器件互连接口已不能胜任。文中采用SRIO(串行RapidIO)技术,设计实现了一种通用的数字信号处理模块,给出了电源和时钟解决方案,实现多个DSP(数字信号... 随着通信技术发展,要求平台的处理能力越来越高,同时器件间数据交互量也急剧增多,传统器件互连接口已不能胜任。文中采用SRIO(串行RapidIO)技术,设计实现了一种通用的数字信号处理模块,给出了电源和时钟解决方案,实现多个DSP(数字信号处理器)、FPGA(现场可编程门阵列)之间10 Gbit/s的互连带宽。平台方案成功应用于某通信系统中,试验结果表明,模块性能高,运行稳定,满足了高性能通用处理平台要求。 展开更多
关键词 SRIO 数字信号处理 ADVANCED Mezzanine Card(AMC)
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综合化航空电子系统中信号处理模块的健康管理方法 被引量:1
7
作者 吴海燕 《电子设计工程》 2024年第1期35-38,43,共5页
随着我国航空电子系统高集成综合化的广泛应用,针对我国航空领域健康管理技术体系不完善、缺少健康管理系统设计、验证技术等问题,就综合化系统中的重要计算单元——信号处理模块,设计了一种标准接口模型,实现了此模型下的模块初始化、... 随着我国航空电子系统高集成综合化的广泛应用,针对我国航空领域健康管理技术体系不完善、缺少健康管理系统设计、验证技术等问题,就综合化系统中的重要计算单元——信号处理模块,设计了一种标准接口模型,实现了此模型下的模块初始化、自检及状态信息上报、门限设置、日志记录等模块健康管理功能及故障上报功能。该方法通过模块管理和功能应用解耦,保证了健康管理方法的独立性、通用性以及故障上报和状态收集的及时性,大大缩短了任务系统定位故障时间,提高了航空电子系统的可靠性。 展开更多
关键词 rapidio高速串行总线 健康管理 CAN总线 MSU单元
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基于SRIO总线的光纤通信测试系统设计与实现
8
作者 赵子豪 路美娜 +4 位作者 许智龙 吴洋 刘景岩 宋茂新 骆冬根 《大气与环境光学学报》 CAS CSCD 2024年第2期257-264,共8页
针对基于线阵电荷耦合元件(CCD)成像原理的调焦调平系统强实时性、高同步性及高数据率的特点,设计了一种基于串行RapidIO总线协议的光纤通信测试系统。该系统以现场可编程门阵列(FPGA)为控制核心,以光纤为传输介质,通过串行RapidIO总线... 针对基于线阵电荷耦合元件(CCD)成像原理的调焦调平系统强实时性、高同步性及高数据率的特点,设计了一种基于串行RapidIO总线协议的光纤通信测试系统。该系统以现场可编程门阵列(FPGA)为控制核心,以光纤为传输介质,通过串行RapidIO总线协议完成对调焦调平系统性能验证过程中的指令控制和图像数据传输。基于双存储器(FIFO)缓冲的SRIO接口设计使得该测试系统具有较强的通用性和实用性。测试结果表明,该系统光纤接口数据传输速率达440 MB/s,能够满足调焦调平系统性能验证对数据传输速率及正确性的需求。 展开更多
关键词 调焦调平系统 串行rapidio 现场可编程门阵列 光纤通信
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基于RapidIO总线的多DSP信号处理平台设计 被引量:3
9
作者 沈发江 《自动化应用》 2013年第4期23-25,共3页
利用RapidIO作为系统内部互联总线,以TMS320C6678为核心处理器,采用FPGA作为控制单元和转接芯片,设计一种多DSP并行信号处理系统。该方案不仅有效解决了系统连接的瓶颈,并且实现拓扑结构可重构,大幅度提高了系统的信号处理能力。
关键词 多DSP 串行rapidio TSI578 TMS320C6678
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高速串行总线RapidIO与PCI Express技术分析比较 被引量:2
10
作者 田泽 郭海英 《计算机与网络》 2010年第18期64-67,共4页
传统的分层共享总线已无法满足未来高性能嵌入式系统的I/O性能需求和快速高效的信号处理和数据传输。系统内的不同组件之间的彼此通信的速率已成为制约嵌入式系统性能提高的瓶颈。为了缓解I/O瓶颈问题,I/O技术及体系结构发生重大变革,... 传统的分层共享总线已无法满足未来高性能嵌入式系统的I/O性能需求和快速高效的信号处理和数据传输。系统内的不同组件之间的彼此通信的速率已成为制约嵌入式系统性能提高的瓶颈。为了缓解I/O瓶颈问题,I/O技术及体系结构发生重大变革,使新型互联技术不断涌现,如PCI Express,RapidIO等。本文主要对这两种串行总线技术分析比较。 展开更多
关键词 rapidio PCI Express高速串行总线嵌入式
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多通道SRIO数据传输优化设计与应用 被引量:1
11
作者 文丰 徐胜 朱振麟 《单片机与嵌入式系统应用》 2023年第12期84-87,共4页
为了满足遥测系统大容量数据高速可靠传输的需求,提出了一种基于FPGA和Serial RapidIO(SRIO)的数据传输链路优化设计,传输链路为4x模式,传输速率为2.5 Gb/s。针对测试过程中链路异常被训练成1x模式而造成数据传输异常的现象进行深入分析... 为了满足遥测系统大容量数据高速可靠传输的需求,提出了一种基于FPGA和Serial RapidIO(SRIO)的数据传输链路优化设计,传输链路为4x模式,传输速率为2.5 Gb/s。针对测试过程中链路异常被训练成1x模式而造成数据传输异常的现象进行深入分析,采用上电复位和软件复位相结合的方法对传输链路进行优化,经测试验证,优化后的链路数据传输稳定,1路SRIO数据传输速率可达585 MB/s,且无丢帧、误码现象。该设计已成功应用于遥测系统项目,实现高速数据稳定传输。 展开更多
关键词 FPGA serial rapidio协议 SRIO IP核 4x模式 链路异常
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VxWorks下串行RapidIO总线驱动的实现
12
作者 王璐 龚俊 《机电产品开发与创新》 2015年第6期117-119,共3页
为了处理器与总线频率的匹配,实现处理器间的高速通信,提出了一种基于Vx Works嵌入式操作系统的Rapid IO总线驱动的设计方案。Rapid IO硬件平台以MPC8548作为端点处理器,Tsi578芯片作为交换器件。软件部分首先对Rapid IO本地设备进行初... 为了处理器与总线频率的匹配,实现处理器间的高速通信,提出了一种基于Vx Works嵌入式操作系统的Rapid IO总线驱动的设计方案。Rapid IO硬件平台以MPC8548作为端点处理器,Tsi578芯片作为交换器件。软件部分首先对Rapid IO本地设备进行初始化;然后对Rapid IO网络进行枚举与配置;最后完成消息传递。实际应用表明,该系统实现了Rapi IO总线驱动的高速通信需求,达到了设计要求。 展开更多
关键词 串行Rapid IO VXWORKS嵌入式操作系统 总线驱动 高速通信
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串行RapidIO鲁棒性 被引量:1
13
作者 张勇 王勇 张平 《吉林大学学报(工学版)》 EI CAS CSCD 北大核心 2011年第1期276-281,共6页
为克服串行RapidIO(Serial RapidIO,SRIO)互连系统中由于硬件实现的失误和恶劣环境造成的大量噪声与电磁干扰(Electromagnetic interference,EMI),提出了作为现有SRIO规范扩展的鲁棒传输协议(Robust trans portprotocol,ROTP)。ROTP用... 为克服串行RapidIO(Serial RapidIO,SRIO)互连系统中由于硬件实现的失误和恶劣环境造成的大量噪声与电磁干扰(Electromagnetic interference,EMI),提出了作为现有SRIO规范扩展的鲁棒传输协议(Robust trans portprotocol,ROTP)。ROTP用速率转换和模式转换提高SRIO性能。速率转换可提高恶劣环境下的系统平均吞吐量,模式转换可有效减少对反馈信道的使用。仿真与分析表明,ROTP方法可有效增强SRIO在恶劣环境下的鲁棒性,提高系统性能。 展开更多
关键词 通信技术 鲁棒性 鲁棒传输协议 串行rapidio 速率状态 工作模式
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支持多种传输模式的双通路串行RapidIO设计与实现 被引量:2
14
作者 郭欣童 雷元武 郭阳 《计算机工程与科学》 CSCD 北大核心 2019年第2期233-239,共7页
传统的串行RapidIO2.1接口支持3种通道模式(1×、2×、4×)。在2×或1×模式下,4条物理链路只有2条或1条在进行数据传输,其余链路被闲置,造成带宽浪费;另外,一个RapidIO接口只能与一个目的端互连。基于传统的串行Ra... 传统的串行RapidIO2.1接口支持3种通道模式(1×、2×、4×)。在2×或1×模式下,4条物理链路只有2条或1条在进行数据传输,其余链路被闲置,造成带宽浪费;另外,一个RapidIO接口只能与一个目的端互连。基于传统的串行RapidIO2.1接口协议,设计了一种支持双通路传输的串行RapidIO接口,通过PCS层的可配置交叉开关共实现14种传输模式,双通路模式下可同时和两个串行RapidIO接口互连。双通路RapidIO提高了RapidIO系统互连的灵活性和传输带宽。实验结果表明,在1×或2×模式下,双通路传输的传输带宽是传统设计的两倍;4×模式下,双通路RapidIO的有效带宽与传统单通路RapidIO的相同。 展开更多
关键词 串行rapidio 通道模式 双通路 互连灵活性 传输带宽
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RapidIO链的设计方案和应用 被引量:1
15
作者 黄先春 黄登山 骆艳卜 《计算机工程与应用》 CSCD 北大核心 2009年第32期63-64,89,共3页
串行RapidIO支持两种工作方式:Message和DirectIO方式。DirectIO方式使用简单,但是它在连续传输多包的情况下,CPU需要等待LSU寄存器空闲。为了解决该问题,提出了RapidIO链的传输新方案,即用EDMA通道代替CPU配置SRIO的LSU寄存器。实验表... 串行RapidIO支持两种工作方式:Message和DirectIO方式。DirectIO方式使用简单,但是它在连续传输多包的情况下,CPU需要等待LSU寄存器空闲。为了解决该问题,提出了RapidIO链的传输新方案,即用EDMA通道代替CPU配置SRIO的LSU寄存器。实验表明该方案能有效地降低CPU负荷。 展开更多
关键词 高速串行IO 口(SRIO) 增强型内存直接存取(EDMA) CPU负荷
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高速串行RapidIO总线背板信号完整性仿真研究 被引量:3
16
作者 李彦 吴培明 寇小明 《鱼雷技术》 2011年第3期167-171,共5页
信号完整性(SI)是高速电路设计面临的一个主要问题。对109 Hz以上高速信号的信号完整性问题从原理上进行了详细分析,并针对损耗、串扰、反射等因素提出了改善信号完整性的方法。在高速串行RapidIO总线背板的设计中,探索出一套利用HyperL... 信号完整性(SI)是高速电路设计面临的一个主要问题。对109 Hz以上高速信号的信号完整性问题从原理上进行了详细分析,并针对损耗、串扰、反射等因素提出了改善信号完整性的方法。在高速串行RapidIO总线背板的设计中,探索出一套利用HyperLynx工具进行仿真分析和设计验证的方法,即利用前仿真工具LineSim对影响信号完整性的主要参数进行评估,形成设计指导数据;利用后仿真工具BoardSim对布线后的高速背板进行验证,从理论上证明了高速串行RapidIO总线背板的设计是可行的。 展开更多
关键词 信号完整性 高速串行rapidio总线 背板 HYPERLYNX
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一种低时延的串行RapidIO端点设计方案(英文) 被引量:3
17
作者 吴峰锋 贾嵩 +1 位作者 王源 张大成 《北京大学学报(自然科学版)》 EI CAS CSCD 北大核心 2013年第4期570-578,共9页
提出一种可兼容V1.3版本规范的低时延端点实现方案。在该方案中,输出和输入路径上的多数模块工作在直通模式以产生稳定的低时延。对于事务接口,请求和响应可以通过不同的用户定义端口输入并共享传输路径,而且同时发起的事务能在安全的... 提出一种可兼容V1.3版本规范的低时延端点实现方案。在该方案中,输出和输入路径上的多数模块工作在直通模式以产生稳定的低时延。对于事务接口,请求和响应可以通过不同的用户定义端口输入并共享传输路径,而且同时发起的事务能在安全的仲裁机制下保持有序传送。为了防止无效的数据传输,废弃的事务包将会被改进的4队列式缓冲模块撤销。对于串行物理接口,1x/4x链路能为事务包和控制符号提供可靠的数据传送,并实现流量控制、错误检测及恢复等关键的链路管理功能。与参考设计相比,此方案能获得更低的传输时延和更高的数据吞吐率。此方案的功能和性能已通过FPGA平台的验证,因此能满足下一代高速嵌入式互连的应用需求。 展开更多
关键词 rapidio SRIO端点 嵌入式互连 串行物理层 低时延
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基于FPGA的RapidIO总线接口设计与实现技术 被引量:2
18
作者 何玉红 赵琨 《计算机与网络》 2012年第13期57-59,共3页
为了适应新的数字信号处理技术的发展,采用FPGA实现技术设计了串行RapidIO高速串行传输接口,实现了DSP与FPGA之间、FPGA与FPGA之间的高速数据传输,详细介绍了本地端点设备访问和远端设备访问的时序设计过程。对RapidIO总线的性能指标进... 为了适应新的数字信号处理技术的发展,采用FPGA实现技术设计了串行RapidIO高速串行传输接口,实现了DSP与FPGA之间、FPGA与FPGA之间的高速数据传输,详细介绍了本地端点设备访问和远端设备访问的时序设计过程。对RapidIO总线的性能指标进行了测试,试验表明,在1lane、全双工模式下,数据传输速率可达243MB/S,突破了以前DSP的外部接口总线的传输速度瓶颈。 展开更多
关键词 FPGA rapidio 高速串行接口 DSP
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CPS1432交换芯片的串行RapidIO互连技术 被引量:6
19
作者 张健 林锡龙 谢江波 《单片机与嵌入式系统应用》 2014年第12期31-34,共4页
RapidIO技术是世界上第一个、也是目前唯一的嵌入式系统互连国际标准(ISO/IEC18372),串行RapidIO是针对高性能嵌入式系统芯片间和板间互连而设计的。本文介绍了CPS1432交换芯片与P2020组成的星型拓扑网络结构,包括硬件设计方案和软件设... RapidIO技术是世界上第一个、也是目前唯一的嵌入式系统互连国际标准(ISO/IEC18372),串行RapidIO是针对高性能嵌入式系统芯片间和板间互连而设计的。本文介绍了CPS1432交换芯片与P2020组成的星型拓扑网络结构,包括硬件设计方案和软件设计要点,对高性能嵌入式互连设计具有很好的借鉴意义。 展开更多
关键词 串行rapidio CPS1432 P2020
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基于ATE的高速RapidIO交换芯片测试方法 被引量:1
20
作者 李军求 刘天照 刘鹏 《电子产品可靠性与环境试验》 2022年第2期87-92,共6页
RapidIO交换芯片因其出色的延迟及高可靠性而被广泛地应用于各种通信系统中,可以高速地传输系统内各种设备间的数据。基于ATE测试系统对RapidIO交换芯片的测试内容及方法进行了探讨,尤其是对高速串行接口相关参数的测试方法进行了研究,... RapidIO交换芯片因其出色的延迟及高可靠性而被广泛地应用于各种通信系统中,可以高速地传输系统内各种设备间的数据。基于ATE测试系统对RapidIO交换芯片的测试内容及方法进行了探讨,尤其是对高速串行接口相关参数的测试方法进行了研究,并采用高速RapidIO交换芯片开展了测试验证。 展开更多
关键词 rapidio交换芯片 高速串行接口 自动测试设备
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