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Through-silicon-via crosstalk model and optimization design for three-dimensional integrated circuits 被引量:3
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作者 钱利波 朱樟明 +2 位作者 夏银水 丁瑞雪 杨银堂 《Chinese Physics B》 SCIE EI CAS CSCD 2014年第3期591-596,共6页
Through-silicon-via (TSV) to TSV crosstalk noise is one of the key factors affecting the signal integrity of three- dimensional integrated circuits (3D ICs). Based on the frequency dependent equivalent electrical ... Through-silicon-via (TSV) to TSV crosstalk noise is one of the key factors affecting the signal integrity of three- dimensional integrated circuits (3D ICs). Based on the frequency dependent equivalent electrical parameters for the TSV channel, an analytical crosstalk noise model is established to capture the TSV induced crosstalk noise. The impact of various design parameters including insulation dielectric, via pitch, via height, silicon conductivity, and terminal impedance on the crosstalk noise is analyzed with the proposed model. Two approaches are proposed to alleviate the TSV noise, namely, driver sizing and via shielding, and the SPICE results show 241 rnV and 379 mV reductions in the peak noise voltage, respectively. 展开更多
关键词 three-dimensional integrated circuits through-silicon-via crosstalk driver sizing via shielding
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高深宽比硅孔溅射铜种子层工艺的探索与研究
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作者 付学成 刘民 +2 位作者 张笛 程秀兰 王英 《真空》 CAS 2024年第4期1-5,共5页
硅通孔技术(TSV)是当前非常热门的高密度封装技术,但由于常规薄膜沉积技术很难在高深宽比的硅孔内沉积铜、钨等金属种子层,硅通孔技术中存在深硅孔金属化困难的工艺问题。通过对倾斜溅射时铜原子二维非对心碰撞前后入射角度的变化关系... 硅通孔技术(TSV)是当前非常热门的高密度封装技术,但由于常规薄膜沉积技术很难在高深宽比的硅孔内沉积铜、钨等金属种子层,硅通孔技术中存在深硅孔金属化困难的工艺问题。通过对倾斜溅射时铜原子二维非对心碰撞前后入射角度的变化关系进行模拟计算发现,当原子碰撞有能量损失时,入射到硅孔内的铜原子角度会发生改变,有助于其沉积在硅孔深处。本文利用负偏压辅助多个铜靶共焦溅射的方式,在不同深宽比的硅盲孔中沉积铜种子层,验证了该方法的可行性,并通过三靶共焦溅射成功在深宽比8∶1的硅孔内实现了铜种子层的沉积。 展开更多
关键词 硅通孔技术 多靶共焦溅射 铜种子层
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超宽带硅基射频微系统设计
3
作者 张先荣 钟丽 《电讯技术》 北大核心 2024年第9期1507-1515,共9页
针对超宽带硅基射频模块的微系统化问题,采用硅基板作为转接板设计了一款具备收发功能的超宽带系统级封装(System in Package,SiP)射频微系统。各层硅基转接板之间的射频信号传输、控制和供电等均采用低损耗的硅通孔(Through Silicon Vi... 针对超宽带硅基射频模块的微系统化问题,采用硅基板作为转接板设计了一款具备收发功能的超宽带系统级封装(System in Package,SiP)射频微系统。各层硅基转接板之间的射频信号传输、控制和供电等均采用低损耗的硅通孔(Through Silicon Via,TSV)结构来实现。为了减小封装对射频性能的影响,整个超宽带射频微系统采用5层硅基封装结构,与传统二维封装结构相比,其体积减少95%以上。射频微系统封装完成后,对其电气性能指标进行了测试。在整个超宽带频带内,其接收噪声系数小于2.6 dB,增益大于35 dB,发射功率大于等于34 dBm,端口驻波小于2。该封装结构实现了硅基超宽带射频模块的微系统化,可广泛适用于各类超宽带射频系统。 展开更多
关键词 超宽带射频微系统 硅基转接板 硅通孔(TSV) 系统级封装(SiP)
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集成硅基转接板的PDN供电分析
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作者 何慧敏 廖成意 +2 位作者 刘丰满 戴风伟 曹睿 《电子与封装》 2024年第6期69-80,共12页
集成硅转接板的2.5D/3D封装是实现Chiplet技术的重要封装方案。总结了传统电源分配网络(PDN)的供电机理,分析了先进封装下PDN存在的直流压降过大、路径电阻大等电源完整性问题,介绍了针对硅基转接板上PDN的等效电路建模方法,重点概述了2... 集成硅转接板的2.5D/3D封装是实现Chiplet技术的重要封装方案。总结了传统电源分配网络(PDN)的供电机理,分析了先进封装下PDN存在的直流压降过大、路径电阻大等电源完整性问题,介绍了针对硅基转接板上PDN的等效电路建模方法,重点概述了2.5D/3D封装下PDN的建模与优化。通过将整块的大尺寸硅桥拆分为多个小硅桥、硅桥集成硅通孔(TSV)、增加TSV数量等方式减少电源噪声。最后,对比采用不同集成方案的DC-DC电源管理模块的PDN性能,结果表明,片上集成方案在交流阻抗、电源噪声以及直流压降等指标上都优于传统的基板集成方案,是3D Chiplet中具有潜力的供电方案。 展开更多
关键词 2.5D/3D封装 芯粒 电源分配网络 硅通孔
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硅通孔三维堆叠芯片可靠性标准研究
5
作者 李锟 《信息技术与标准化》 2024年第7期42-46,共5页
针对硅通孔(TSV)三维堆叠芯片在微电子封装领域面临的可靠性挑战,阐述了TSV三维堆叠的工艺流程,分析了TSV孔的制造、芯片减薄、三维键合和组装等关键工艺环节对可靠性的影响,并探讨了TSV孔的质量和可靠性等问题。基于当前TSV三维堆叠芯... 针对硅通孔(TSV)三维堆叠芯片在微电子封装领域面临的可靠性挑战,阐述了TSV三维堆叠的工艺流程,分析了TSV孔的制造、芯片减薄、三维键合和组装等关键工艺环节对可靠性的影响,并探讨了TSV孔的质量和可靠性等问题。基于当前TSV三维堆叠芯片的可靠性标准,明确了可靠性应力试验条件与推荐的检测方法,为提升TSV三维堆叠芯片的可靠性和制造效率提供科学依据和实践策略,促进技术的优化与升级。 展开更多
关键词 硅通孔 三维堆叠 可靠性
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基于两步刻蚀工艺的锥形TSV制备方法
6
作者 田苗 刘民 +3 位作者 林子涵 付学成 程秀兰 吴林晟 《半导体技术》 CAS 北大核心 2024年第4期316-322,共7页
以硅通孔(TSV)为核心的2.5D/3D封装技术可以实现芯片之间的高速、低功耗和高带宽的信号传输。常见的垂直TSV的制造工艺复杂,容易造成填充缺陷。锥形TSV的侧壁倾斜,开口较大,有利于膜层沉积和铜电镀填充,可降低工艺难度和提高填充质量。... 以硅通孔(TSV)为核心的2.5D/3D封装技术可以实现芯片之间的高速、低功耗和高带宽的信号传输。常见的垂直TSV的制造工艺复杂,容易造成填充缺陷。锥形TSV的侧壁倾斜,开口较大,有利于膜层沉积和铜电镀填充,可降低工艺难度和提高填充质量。在相对易于实现的刻蚀条件下制备了锥形TSV,并通过增加第二步刻蚀来改善锥形TSV形貌。成功制备了直径为10~40μm、孔口为喇叭形的锥形TSV。通过溅射膜层和铜电镀填充,成功实现了直径为15μm、深度为60μm的锥形TSV的连续膜层沉积和完全填充,验证了两步刻蚀工艺的可行性和锥形TSV在提高膜层质量和填充效果方面的优势。为未来高密度封装领域提供了一种新的TSV制备工艺,在降低成本的同时提高了2.5D/3D封装技术的性能。 展开更多
关键词 硅通孔(TSV) 锥形 种子层 电镀填充 薄膜沉积
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微模具重复利用的高深宽比铜微结构微电铸复制技术
7
作者 苏少雄 孙云娜 +3 位作者 宋嘉诚 吴永进 姚锦元 丁桂甫 《微纳电子技术》 CAS 2024年第4期162-169,共8页
针对紫外线光刻、电铸成型和注塑(UV-LIGA)工艺的去胶难题,提出了一种以脱模代替去胶的改良工艺,用于批量制造高深宽比铜微结构。该工艺以可重复利用的硅橡胶软模具代替传统的SU-8光刻微模具,采用硅通孔(TSV)镀铜技术进行微电铸填充,然... 针对紫外线光刻、电铸成型和注塑(UV-LIGA)工艺的去胶难题,提出了一种以脱模代替去胶的改良工艺,用于批量制造高深宽比铜微结构。该工艺以可重复利用的硅橡胶软模具代替传统的SU-8光刻微模具,采用硅通孔(TSV)镀铜技术进行微电铸填充,然后通过直接脱模实现金属微结构的完全释放,既解决了去胶难题,又能够解决高深宽比微模具电铸因侧壁金属化导致的空洞包夹问题,同时可以大幅降低成套工艺成本。仿真和实验结果显示,热处理可以改善脱模效果,显著降低脱模损伤,支持微模具重复利用。采用初步优化的改良工艺已成功实现深宽比约3∶1的铜微结构的高精度复制。 展开更多
关键词 紫外线光刻、电铸成型和注塑(UV-LIGA)工艺 硅橡胶模具 硅通孔(TSV)镀铜 脱模 模具重复利用
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基于硅通孔的三维微系统互联结构总剂量效应损伤机制研究
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作者 王昊 陈睿 +7 位作者 陈钱 韩建伟 于新 孟德超 杨驾鹏 薛玉雄 周泉丰 韩瑞龙 《原子能科学技术》 EI CAS CSCD 北大核心 2024年第8期1789-1796,共8页
垂直硅通孔(TSV)作为三维集成微系统的核心技术之一,可以通过多个平面层器件的垂直堆叠有效降低互联延迟,提高集成密度,减少芯片功耗。利用^(60)Co γ射线实验装置,以自主设计的基于TSV的三维互联结构作为实验对象,进行了总剂量效应敏... 垂直硅通孔(TSV)作为三维集成微系统的核心技术之一,可以通过多个平面层器件的垂直堆叠有效降低互联延迟,提高集成密度,减少芯片功耗。利用^(60)Co γ射线实验装置,以自主设计的基于TSV的三维互联结构作为实验对象,进行了总剂量效应敏感性分析。实验发现,随着累积辐照剂量的增加,TSV信号通道的插入损耗(S_(21))减小,回波损耗(S_(11))增大,信号传输效率不断降低。结果表明,总剂量效应诱发TSV内部寄生MOS结构产生氧化层陷阱电荷和界面态陷阱电荷导致了寄生MOS电容C-V曲线出现“负漂”现象,由此引起的信号通道特征阻抗不连续是TSV出现信号完整性问题的内在机制。基于RLGC等效电路模型,利用Keysight ADS仿真软件验证了TSV内部寄生MOS电容总剂量效应的辐射响应规律。 展开更多
关键词 硅通孔 总剂量效应 寄生MOS电容 插入损耗 回波损耗
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基于倾斜旋转方法磁控溅射制备TSV阻挡层
9
作者 申菊 卢林红 +4 位作者 杜承钢 冉景杨 闵睿 杨发顺 马奎 《半导体技术》 CAS 北大核心 2024年第8期726-731,共6页
硅通孔(TSV)是实现三维集成的关键技术,在TSV侧壁制备连续和均匀的阻挡层至关重要。提出了一种磁控溅射制备TSV侧壁阻挡层的方法,将溅射基台倾斜一定角度并水平匀速旋转,使溅射离子的掉落方向与TSV侧壁不平行,靶材离子更容易溅射沉积在... 硅通孔(TSV)是实现三维集成的关键技术,在TSV侧壁制备连续和均匀的阻挡层至关重要。提出了一种磁控溅射制备TSV侧壁阻挡层的方法,将溅射基台倾斜一定角度并水平匀速旋转,使溅射离子的掉落方向与TSV侧壁不平行,靶材离子更容易溅射沉积在TSV侧壁,使得TSV侧壁都能被溅射到,更有利于制备连续和均匀的阻挡层。使用Ti靶进行直流磁控溅射,优化溅射电流和溅射气压,通过扫描电子显微镜(SEM)对TSV侧壁阻挡层的形貌进行表征分析。随着溅射电流和溅射气压的增大,阻挡层的厚度会增加,但是溅射气压的增大使得溅射钛晶粒变得细长,从而导致阻挡层的均匀性和致密性变差。 展开更多
关键词 硅通孔(TSV) 阻挡层 磁控溅射 溅射电流 溅射气压
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博世扇贝纹对亚微米硅通孔中应力的影响
10
作者 费思量 王珺 《半导体技术》 CAS 北大核心 2024年第7期666-673,共8页
硅通孔(TSV)是三维(3D)集成中的关键互连技术。采用博世(Bosch)工艺刻蚀TSV,尤其是亚微米直径的TSV时,侧壁产生的扇贝纹会引起TSV中的应力集中。利用有限元单元生死技术分析亚微米TSV制备过程中的应力变化,并对应力的影响因素进行了分... 硅通孔(TSV)是三维(3D)集成中的关键互连技术。采用博世(Bosch)工艺刻蚀TSV,尤其是亚微米直径的TSV时,侧壁产生的扇贝纹会引起TSV中的应力集中。利用有限元单元生死技术分析亚微米TSV制备过程中的应力变化,并对应力的影响因素进行了分析。研究了TSV节距、扇贝纹高度和宽度、阻挡层材料参数、工艺温度和工作温度等因素对TSV内部应力的影响,并选择了4个主要因素进行正交实验分析。研究结果表明,减小扇贝纹宽度、增大扇贝纹高度、降低工艺温度均能有效缓解扇贝纹附近的应力波动幅度,其中扇贝纹宽度对应力波动的影响最大。通过上述分析,对影响亚微米TSV应力的主要因素进行了排序,从而为TSV制备过程中的参数优化提供了指导。 展开更多
关键词 扇贝纹 亚微米硅通孔(TSV) 有限元分析 正交实验 单元生死技术 博世(Bosch)工艺
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基于三维异构集成技术的X波段4通道收发模组
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作者 李晓林 高艳红 +1 位作者 赵宇 许春良 《太赫兹科学与电子信息学报》 2024年第5期575-579,共5页
基于硅基微电子机械系统(MEMS)三维异构集成工艺,设计了一款适用于相控阵天线系统的三维堆叠4通道T/R模组。模组由3层功能芯片堆叠而成,3层功能芯片之间采用贯穿硅通孔(TSV)和球栅阵列实现电气互连;模组集成了6位数控移相、6位数控衰减... 基于硅基微电子机械系统(MEMS)三维异构集成工艺,设计了一款适用于相控阵天线系统的三维堆叠4通道T/R模组。模组由3层功能芯片堆叠而成,3层功能芯片之间采用贯穿硅通孔(TSV)和球栅阵列实现电气互连;模组集成了6位数控移相、6位数控衰减、串转并、负压偏置和电源调制等功能,最终尺寸为12 mm×12 mm×3.8 mm。测试结果表明,在X波段内,模组的饱和发射输出功率为30 dBm,单通道发射增益可达27 dB,接收通道增益为23 dB,噪声系数小于1.65 dB。该模组性能优异,集成度高,适合批量生产。 展开更多
关键词 微系统 T/R模组 三维异构集成 微电子机械系统 硅通孔
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Low capacitance and highly reliable blind through-silicon-vias(TSVs) with vacuum-assisted spin coating of polyimide dielectric liners 被引量:1
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作者 YAN YangYang XIONG Miao +2 位作者 LIU Bin DING YingTao CHEN ZhiMing 《Science China(Technological Sciences)》 SCIE EI CAS CSCD 2016年第10期1581-1590,共10页
Low-k and high aspect ratio blind through-silicon-vias (TSVs) to be applied in "via-last/backside via" 3-D integration paradigm were fabricated with polyimide dielectric liners formed by vacuum-assisted spin coati... Low-k and high aspect ratio blind through-silicon-vias (TSVs) to be applied in "via-last/backside via" 3-D integration paradigm were fabricated with polyimide dielectric liners formed by vacuum-assisted spin coating technique. MIS trench capacitors with diameter of-6 μm and depth of-54 μm were successfully fabricated with polyimide insulator step coverage better than 30%. C-V characteristics and leakage current properties of the MIS trench capacitor were evaluated under thermal treat- ment. Experimental results show that, the minimum capacitance density is around 4.82 nF/cm2, and the leakage current density after 30 cycles of thermal chock tests becomes stable and it is around 30 nA/cm2 under bias voltage of 20 V. It also shows that, the polyimide dielectric liner is with an excellent capability in constraining copper ion diffusion and mobile charges even un- der test temperature as high as 125℃. Finite element analysis results show that TSVs with polyimide dielectric liner are with lower risks in SiO2 interlayer dielectric (ILD) fracture and interfacial delamination along dielectric-silicon interface, thus, higher thermo-mechanical reliability can be expected. 展开更多
关键词 low capacitance through-silicon-vias (TSVs) polyimide liner 3-D integration vacuum-assisted spin coating FEA
原文传递
Investigation on mechanism of polymer filling in high-aspect-ratio trenches for through-silicon-via(TSV) application 被引量:1
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作者 DING YingTao YAN YangYang +3 位作者 CHEN QianWen WANG ShiWei CHEN Xiu CHEN YueYang 《Science China(Technological Sciences)》 SCIE EI CAS 2014年第8期1616-1625,共10页
Vacuum-assisted spin-coating is an effective polymer filling technology for sidewall insulating of through-silicon-via(TSV).This paper investigated the flow mechanism of the vacuum-assisted polymer filling process bas... Vacuum-assisted spin-coating is an effective polymer filling technology for sidewall insulating of through-silicon-via(TSV).This paper investigated the flow mechanism of the vacuum-assisted polymer filling process based on experiments and numerical simulation,and studied the effect of vacuum pressure,viscosity of polymer and aspect-ratio of trench on the filling performance.A 2D axisymmetric model,consisting of polymer partially filled into the trench and void at the bottom of trench,was developed for the computational fluid dynamics(CFD)simulation.The simulation results indicate that the vacuum-assisted polymer filling process goes through four stages,including bubble formation,bubble burst,air elimination and polymer re-filling.Moreover,the simulation results suggest that the pressure significantly affects the bubble formation and the polymer re-filling procedure,and the polymer viscosity and the trench aspect-ratio influence the duration of air elimination. 展开更多
关键词 through-silicon-via (TSV) vacuum process polymer filling computational fluid dynamics (CFD)
原文传递
基于硅通孔互连的芯粒集成技术研究进展 被引量:1
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作者 张爱兵 李洋 +2 位作者 姚昕 李轶楠 梁梦楠 《电子与封装》 2024年第6期95-108,共14页
通过先进封装技术实现具有不同功能、工艺节点的异构芯粒的多功能、高密度、小型化集成是延续摩尔定律的有效方案之一。在各类的先进封装解决方案中,通过硅通孔(TSV)技术实现2.5D/3D封装集成,可以获得诸多性能优势,如极小的产品尺寸、... 通过先进封装技术实现具有不同功能、工艺节点的异构芯粒的多功能、高密度、小型化集成是延续摩尔定律的有效方案之一。在各类的先进封装解决方案中,通过硅通孔(TSV)技术实现2.5D/3D封装集成,可以获得诸多性能优势,如极小的产品尺寸、极短的互连路径、极佳的产品性能等。对TSV技术的应用分类进行介绍,总结并分析了目前业内典型的基于TSV互连的先进集成技术,介绍其工艺流程和工艺难点,对该类先进封装技术的发展趋势进行展望。 展开更多
关键词 硅通孔 先进封装 芯粒 异构集成 2.5D封装 3D封装
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面向小卫星的航天电子微系统集成技术
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作者 匡乃亮 刘莹玉 +2 位作者 郭雁蓉 赵超 王艳玲 《先进小卫星技术(中英文)》 2024年第2期54-63,共10页
在卫星小型化、星座巨型化的背景下,为支撑中国航天电子技术的自主可控发展,航天电子微系统集成等技术的应用至关重要,该技术的核心是设计和制造.面向小卫星的微系统模块需要在空间环境适应性的基础上,利用微系统建模与仿真工具实现“... 在卫星小型化、星座巨型化的背景下,为支撑中国航天电子技术的自主可控发展,航天电子微系统集成等技术的应用至关重要,该技术的核心是设计和制造.面向小卫星的微系统模块需要在空间环境适应性的基础上,利用微系统建模与仿真工具实现“芯片封装系统”一体化的协同设计,系统性地优化模块的电源完整性、信号完整性和电磁兼容性.利用硅通孔技术和封装堆叠技术实现模块的三维集成封装.通过对设计和制造两方面核心技术方法的详细介绍,以及典型模块产品的展示,说明了中国在航天电子微系统集成技术领域的积累已具备支持小卫星产品“工业化”发展的能力. 展开更多
关键词 小卫星 微系统 协同设计 硅通孔 封装堆叠
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硅转接板制造与集成技术综述
16
作者 徐成 樊嘉祺 +3 位作者 张宏伟 王华 陈天放 刘丰满 《电子与封装》 2024年第6期48-58,I0003,共12页
集成电路制程发展放缓,具有高密度、高集成度以及高速互连优势的先进封装技术成为提升芯片性能的关键。硅转接板可实现三维方向的最短互连以及芯片间的高速互连,是高算力和人工智能应用的主流封装技术。从硅转接板设计、制造以及2.5D/3... 集成电路制程发展放缓,具有高密度、高集成度以及高速互连优势的先进封装技术成为提升芯片性能的关键。硅转接板可实现三维方向的最短互连以及芯片间的高速互连,是高算力和人工智能应用的主流封装技术。从硅转接板设计、制造以及2.5D/3D集成等方面,系统阐述了硅转接板技术的发展现状和技术难点,并对相关关键工艺技术进行详细介绍。 展开更多
关键词 先进封装 硅转接板 硅通孔 三维集成
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硅通孔3D互连热-力可靠性的研究与展望
17
作者 吴鲁超 陆宇青 王珺 《电子与封装》 2024年第6期18-33,共16页
硅通孔(TSV)技术是3D集成封装中用于实现高密度、高性能互连的关键技术,TSV的热-力可靠性对3D集成封装的性能和寿命有直接影响。从TSV的制造工艺、结构布局、材料可靠性以及评估方法等多个方面对TSV 3D互连的热-力可靠性进行研究,对其... 硅通孔(TSV)技术是3D集成封装中用于实现高密度、高性能互连的关键技术,TSV的热-力可靠性对3D集成封装的性能和寿命有直接影响。从TSV的制造工艺、结构布局、材料可靠性以及评估方法等多个方面对TSV 3D互连的热-力可靠性进行研究,对其研究方法和研究现状进行总结和阐述。此外,针对TSV尺寸减小至纳米级的发展趋势,探讨了纳米级TSV在应用于先进芯片背部供电及更高密度的芯片集成时所面临的可靠性挑战。 展开更多
关键词 封装技术 硅通孔 3D互连 热-力可靠性
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退火对TSV电镀铜膜层性能影响研究
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作者 于仙仙 蒋闯 张翠翠 《电镀与精饰》 CAS 北大核心 2024年第10期42-49,共8页
针对硅通孔(TSV)高深宽比微孔电镀填铜后结晶细小,后续制程经历高温过程可能导致晶界间缺陷的问题,对TSV电镀铜膜层退火后性能变化进行了研究。考察了退火温度和升温速率等退火条件对晶粒晶面取向、晶粒大小、晶界间空洞以及杂质含量等... 针对硅通孔(TSV)高深宽比微孔电镀填铜后结晶细小,后续制程经历高温过程可能导致晶界间缺陷的问题,对TSV电镀铜膜层退火后性能变化进行了研究。考察了退火温度和升温速率等退火条件对晶粒晶面取向、晶粒大小、晶界间空洞以及杂质含量等膜层性能的影响,确定了较优的退火工艺参数为升温速率10/min℃,400℃下保温2 h。结果表明:此较优的高温退火条件下,XRD显示主晶面择优取向为Cu(111);SIMS分析电镀铜膜层总杂质含量小于100 mg·kg^(–1);EBSD结果显示电镀铜平均粒径1.9μm,晶粒长大较充分,满足工业化应用需求,希望对工业化应用提供参考。 展开更多
关键词 硅通孔 电镀铜 添加剂 退火 缺陷 化学机械抛光 可靠性
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含丙二醇的复合有机抑制剂应用于TSV镀铜工艺的研究
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作者 史筱超 于仙仙 王溯 《电镀与涂饰》 CAS 北大核心 2024年第1期43-49,共7页
[目的]硅通孔(TSV)电镀铜填充一般采用PEG(聚乙二醇)类有机化合物抑制剂,但往往存在电镀时间长、易产生空洞、面铜较厚、退火后晶界间缺陷多等问题。[方法]开发了一种新型含丙二醇的复合有机抑制剂,研究了采用它时的TSV填充模式,退火后... [目的]硅通孔(TSV)电镀铜填充一般采用PEG(聚乙二醇)类有机化合物抑制剂,但往往存在电镀时间长、易产生空洞、面铜较厚、退火后晶界间缺陷多等问题。[方法]开发了一种新型含丙二醇的复合有机抑制剂,研究了采用它时的TSV填充模式,退火后孔内镀层的结晶状态,以及镀层的杂质含量。[结果]该抑制剂对TSV的填充效果明显优于传统抑制剂,与小分子含硫化合物加速剂复配使用时可实现“自下而上”的均匀填充,且面铜平整,无微孔、气泡等缺陷存在。[结论]该复合有机抑制剂具有很好的工业化应用潜力。 展开更多
关键词 硅通孔 电镀铜 丙二醇 有机抑制剂 自下而上填充
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多层硅基模块晶圆级键合腔体的可靠性
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作者 马将 郜佳佳 杨栋 《半导体技术》 CAS 北大核心 2024年第7期674-681,共8页
晶圆级键合是实现多层硅基模块内部互连的关键工艺,针对硅片在晶圆级键合工艺中的开裂现象,建立了硅基刻蚀腔体在键合工艺中的力学模型,经样件实验验证,该模型可以准确预估腔体的开裂现象。在此基础上设计了硅片键合实验,通过引入硅通孔... 晶圆级键合是实现多层硅基模块内部互连的关键工艺,针对硅片在晶圆级键合工艺中的开裂现象,建立了硅基刻蚀腔体在键合工艺中的力学模型,经样件实验验证,该模型可以准确预估腔体的开裂现象。在此基础上设计了硅片键合实验,通过引入硅通孔(TSV)的应力集中因子确定了硅基晶圆级键合的应力失效判据。而后通过参数化仿真系统性探究了硅基刻蚀腔体面积及腔体形状等因素对键合应力的影响规律,并绘制出刻蚀腔体设计可靠范围图。结果表明,硅片键合可靠腔体临界面积约为21 mm^(2),且腔体形状越接近正方形越易开裂。该研究为多层硅基模块刻蚀腔体的可靠性设计提供了参考。 展开更多
关键词 晶圆级键合 多层硅基模块 刻蚀腔体 硅通孔(TSV) 可靠性
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