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题名FPU中一种高速乘法运算电路的设计与实现
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作者
王永海
周端
李波
常宪栋
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机构
西安电子科技大学计算机学院
山东省济南市边防局
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出处
《桂林电子工业学院学报》
2003年第5期38-41,共4页
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文摘
在FPU的设计中,乘法运算电路是设计高精度高速度的乘法电路的重要部分,对提高整个FPU的性能具有重要的意义。通过对浮点处理单元(FPU)的体系结构的分析,比较了速度和规模分析并行通用乘法器之间的优缺点,结合FPU整体设计以及兼顾速度和规模,提出一种不同于通用乘法器设计的方法。该方法采用指数、尾数两条数据通道,用基-4的Booth算法和桶形移位寄存器,通过迭代完成乘法计算,并用VerilogHDL语言编写模块,用Modelsim进行仿真验证。这种方法速度快、占用硬件资源少,适于在FPU中实现,也可以做为一个独立的乘法器使用。
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关键词
FPU
乘法运算电路
浮点处理单元
BOOTH算法
VERILOGHDL语言
MODELSIM
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Keywords
FPU, Multiplying operational circuit, Booth algorithm, VerilogHDL, Modelsim
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分类号
TP332.22
[自动化与计算机技术—计算机系统结构]
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