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支持日志乱序提交的分布式一致性协议
1
作者
王进
李博涵
+1 位作者
吴佳骏
宋欣洋
《浙江大学学报(工学版)》
EI
CAS
CSCD
北大核心
2023年第2期320-329,共10页
为了解决Raft算法中日志提交的严格串行化设计,提出一种Raft协议变体:并行提交Raft (PC-Raft). PCRaft在日志提交阶段运用流水线,重新设计日志缓冲区,实现日志的乱序提交.传输方式使用RDMA网络,在提高日志传输的并发性的同时加快传输速...
为了解决Raft算法中日志提交的严格串行化设计,提出一种Raft协议变体:并行提交Raft (PC-Raft). PCRaft在日志提交阶段运用流水线,重新设计日志缓冲区,实现日志的乱序提交.传输方式使用RDMA网络,在提高日志传输的并发性的同时加快传输速度.在日志执行阶段,采用批处理,将多条指令打包发送给状态机逐条执行.针对日志并行提交情况下会出现的幽灵复现问题,采用LSN与任期号结合的方式保证日志的安全性.针对日志乱序提交会出现的日志空洞问题,重新设计领导者选举算法,在选举中加入临时领导者,保证选举出的领导者能最快恢复日志.测试结果证明PC-Raft对比Raft在吞吐量方面有着明显的性能提升,同时延迟更低,并且在日志指令依赖频繁的情况下,吞吐量比现有基于Raft的变体更高,延迟也更低.
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关键词
一致性协议
Paxos
RAFT
PC-Raft
乱序提交
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职称材料
超标量处理器乱序提交机制的研究与设计
被引量:
1
2
作者
李昭
刘有耀
+1 位作者
焦继业
潘树朋
《计算机工程》
CAS
CSCD
北大核心
2021年第4期180-186,共7页
针对超标量处理器中长周期执行指令延迟退休及持续译码导致的重排序缓存(ROB)阻塞问题,提出一种指令乱序提交机制。通过设计容量可配置的多缓存指令提交结构,实现存储器操作指令和ALU类型指令的分类退休,根据超标量处理器架构及性能需...
针对超标量处理器中长周期执行指令延迟退休及持续译码导致的重排序缓存(ROB)阻塞问题,提出一种指令乱序提交机制。通过设计容量可配置的多缓存指令提交结构,实现存储器操作指令和ALU类型指令的分类退休,根据超标量处理器架构及性能需求对目标缓存和存储缓存容量进行参数化配置降低流水线阻塞风险,同时利用指令目的寄存器编码提交模式加快指令提交速率。实验结果表明,该机制提高了单次指令提交数量,基于该机制的超标量处理器相比传统基于ROB顺序提交机制的超标量处理器在减少硬件开销的情况下平均IPC指数提升46%,相比基于值预测、乱序退休和组提交的超标量处理器平均IPC指数增益为19%,综合性能更优。
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关键词
超标量处理器
重排序缓存
指令分类退休
乱序提交
目的寄存器编码
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职称材料
题名
支持日志乱序提交的分布式一致性协议
1
作者
王进
李博涵
吴佳骏
宋欣洋
机构
南京航空航天大学计算机科学与技术学院
出处
《浙江大学学报(工学版)》
EI
CAS
CSCD
北大核心
2023年第2期320-329,共10页
基金
CCF-华为数据库系统创新研究计划资助项目(CCF HUAWEIDBIR2020001A)。
文摘
为了解决Raft算法中日志提交的严格串行化设计,提出一种Raft协议变体:并行提交Raft (PC-Raft). PCRaft在日志提交阶段运用流水线,重新设计日志缓冲区,实现日志的乱序提交.传输方式使用RDMA网络,在提高日志传输的并发性的同时加快传输速度.在日志执行阶段,采用批处理,将多条指令打包发送给状态机逐条执行.针对日志并行提交情况下会出现的幽灵复现问题,采用LSN与任期号结合的方式保证日志的安全性.针对日志乱序提交会出现的日志空洞问题,重新设计领导者选举算法,在选举中加入临时领导者,保证选举出的领导者能最快恢复日志.测试结果证明PC-Raft对比Raft在吞吐量方面有着明显的性能提升,同时延迟更低,并且在日志指令依赖频繁的情况下,吞吐量比现有基于Raft的变体更高,延迟也更低.
关键词
一致性协议
Paxos
RAFT
PC-Raft
乱序提交
Keywords
consistency protocol
Paxos
Raft
PC-Raft
out-of-order submission
分类号
TP311 [自动化与计算机技术—计算机软件与理论]
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职称材料
题名
超标量处理器乱序提交机制的研究与设计
被引量:
1
2
作者
李昭
刘有耀
焦继业
潘树朋
机构
西安邮电大学电子工程学院
西安邮电大学计算机学院
出处
《计算机工程》
CAS
CSCD
北大核心
2021年第4期180-186,共7页
基金
国家自然科学基金(61874087,61834005,61634004)。
文摘
针对超标量处理器中长周期执行指令延迟退休及持续译码导致的重排序缓存(ROB)阻塞问题,提出一种指令乱序提交机制。通过设计容量可配置的多缓存指令提交结构,实现存储器操作指令和ALU类型指令的分类退休,根据超标量处理器架构及性能需求对目标缓存和存储缓存容量进行参数化配置降低流水线阻塞风险,同时利用指令目的寄存器编码提交模式加快指令提交速率。实验结果表明,该机制提高了单次指令提交数量,基于该机制的超标量处理器相比传统基于ROB顺序提交机制的超标量处理器在减少硬件开销的情况下平均IPC指数提升46%,相比基于值预测、乱序退休和组提交的超标量处理器平均IPC指数增益为19%,综合性能更优。
关键词
超标量处理器
重排序缓存
指令分类退休
乱序提交
目的寄存器编码
Keywords
superscalar processor
Reorder Buffer(ROB)
instruction classification retirement
out-of-order submission
destination register encoding
分类号
TP338 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
支持日志乱序提交的分布式一致性协议
王进
李博涵
吴佳骏
宋欣洋
《浙江大学学报(工学版)》
EI
CAS
CSCD
北大核心
2023
0
下载PDF
职称材料
2
超标量处理器乱序提交机制的研究与设计
李昭
刘有耀
焦继业
潘树朋
《计算机工程》
CAS
CSCD
北大核心
2021
1
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职称材料
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