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一个用户级动态二进制翻译系统的设计与实现 被引量:2
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作者 曹宏嘉 俞磊 +1 位作者 邓鵾 周兴铭 《计算机工程与科学》 CSCD 2004年第8期79-82,99,共5页
本文介绍了一个x86Linux系统下动态二进制翻译系统的设计与实现,该系统将IA 32用户级整数代码翻译到一个RISC指令集并由模拟器执行目标代码;详细描述了该系统的总体组成、目标结构模拟器、代码翻译过程以及翻译过的代码的执行。
关键词 编译程序 RISC指令集 设计 用户级动态二进制翻译系统
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二进制翻译系统BATSUP中的动态翻译器的设计与实现
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作者 黄英兰 杨晋兴 钟珊 《航空计算技术》 2005年第3期50-53,58,共5页
针对目前航电系统硬件的升级换代而导致老的软件的不可用的问题,提出了一个用于航电系统软件升级的二进制翻译系统(BTASUP系统)。该系统能把解释执行和动态翻译结合起来,在PowerPC处理器上实现对1750A处理器的二进制可执行代码的透明执... 针对目前航电系统硬件的升级换代而导致老的软件的不可用的问题,提出了一个用于航电系统软件升级的二进制翻译系统(BTASUP系统)。该系统能把解释执行和动态翻译结合起来,在PowerPC处理器上实现对1750A处理器的二进制可执行代码的透明执行。介绍了系统的结构和工作原理,重点讨论了作为系统重要组成部分的动态翻译器的设计与实现。 展开更多
关键词 二进制翻译系统 解释执行 动态翻译 动态翻译
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BTASUP二进制翻译系统的性能改善策略
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作者 黄英兰 马满堂 张旻 《微处理机》 2008年第1期111-114,118,共5页
针对目前航电系统硬件的升级换代而导致老软件不可用的问题,提出了一个用于航电系统软件升级的二进制翻译系统(BTASUP系统)。该系统能把解释执行和动态翻译结合起来,在PowerPC处理器上实现对1750A处理器二进制可执行代码的透明执行。介... 针对目前航电系统硬件的升级换代而导致老软件不可用的问题,提出了一个用于航电系统软件升级的二进制翻译系统(BTASUP系统)。该系统能把解释执行和动态翻译结合起来,在PowerPC处理器上实现对1750A处理器二进制可执行代码的透明执行。介绍了系统的结构和工作原理,着重讨论了改进BTASUP系统性能的几种策略。 展开更多
关键词 二进制翻译系统 解释执行 动态翻译 透明执行
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系统级动态二进制翻译系统中访存异常的制导技术研究
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作者 张龙龙 董卫宇 王立新 《信息工程大学学报》 2014年第2期253-256,共4页
访存异常的制导技术对可能引发异常处理的访存指令进行统计和分析,使系统级动态二进制翻译系统能够动态地生成优化后的目标代码。制导技术能够减少目标代码中保存上下文信息的操作次数,提高动态二进制翻译系统执行效率。文章对访存异常... 访存异常的制导技术对可能引发异常处理的访存指令进行统计和分析,使系统级动态二进制翻译系统能够动态地生成优化后的目标代码。制导技术能够减少目标代码中保存上下文信息的操作次数,提高动态二进制翻译系统执行效率。文章对访存异常的制导技术分析并实现,并得到此策略提供的性能提升。 展开更多
关键词 系统级动态二进制翻译 制导 异常处理 性能提升
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系统级动态二进制翻译中的代码Cache索引 被引量:1
5
作者 邢冲 付宇卓 《计算机工程》 CAS CSCD 北大核心 2008年第22期253-255,共3页
针对系统级二进制翻译中多地址空间共存的情况,提出2种使用虚拟地址和物理地址对代码Cache进行索引的方法。物理地址索引方法有助于各个进程共享已被翻译的代码Cache。测试结果表明,在多进程环境下,物理地址索引的性能高于虚拟地址索引。
关键词 系统二进制翻译 物理地址索引 虚拟地址索引
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系统级动态二进制翻译器的中断处理策略 被引量:1
6
作者 龙开文 付宇卓 《计算机工程》 CAS CSCD 北大核心 2008年第22期245-246,249,共3页
中断处理策略是影响系统级动态二进制翻译系统性能的主要因素之一。该文通过分析中断的被动处理策略对系统性能的影响,提出在目标代码执行阶段主动处理中断的策略,并加以实现。实验结果表明,中断的主动处理策略优于被动处理策略。
关键词 中断处理 系统级动态二进制翻译 操作系统
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一种动态二进制翻译中间表示变量活性分析改进算法 被引量:2
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作者 戴涛 单征 +1 位作者 岳峰 崔韫楠 《小型微型计算机系统》 CSCD 北大核心 2016年第2期395-400,共6页
动态二进制翻译是指可实现不同体系结构上软件兼容移植的系统,翻译过程使用源体系结构的一条或多条指令来模拟目标体系结构的一条指令,完成两者指令功能的等价,但也同时增大了代码的膨胀率,降低了程序执行的效率.变量活性分析是提高二... 动态二进制翻译是指可实现不同体系结构上软件兼容移植的系统,翻译过程使用源体系结构的一条或多条指令来模拟目标体系结构的一条指令,完成两者指令功能的等价,但也同时增大了代码的膨胀率,降低了程序执行的效率.变量活性分析是提高二进制翻译系统执行效率重要的方法,本文在QEMU中间表示TCG(Tiny Code Generator)变量活性分析算法的基础上,提出线性扫描冗余ld M和st M指令匹配删除算法删除TCG中间代码冗余指令,有效简化指令翻译.整体性能测试表明,该方法可有效减少TCG中间指令的数目,比QEMU优化前翻译性能平均提高约12%. 展开更多
关键词 动态二进制翻译系统 变量活性分析 QEMU TCG
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基于访问区域特征的高速地址翻译方法 被引量:1
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作者 王荣华 孟建熠 +1 位作者 陈志坚 严晓浪 《浙江大学学报(工学版)》 EI CAS CSCD 北大核心 2014年第2期348-353,共6页
针对系统级二进制翻译器在虚拟/物理地址转换中出现的性能瓶颈问题,提出一种基于指令、数据和堆栈等访问区域特征的快速地址转换方法.该方法在翻译态时识别不同区域的内存访问指令,并根据区域特征采取不同的优化算法,对于指令区域... 针对系统级二进制翻译器在虚拟/物理地址转换中出现的性能瓶颈问题,提出一种基于指令、数据和堆栈等访问区域特征的快速地址转换方法.该方法在翻译态时识别不同区域的内存访问指令,并根据区域特征采取不同的优化算法,对于指令区域和数据区域采用编译时地址转换算法,对于堆栈区域采用连续页面映射算法.在开源高速指令模拟器QEMU上运行嵌人式CPU测试基准程序PowerStone.结果表明,运行态地址转换过程减少了1%~65%,运行态执行周期数减少了11%~38%. 展开更多
关键词 内存访问区域属性 系统二进制翻译 快速地址转换
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An efficient adapting virtual intermediate instruction set towards optimized dynamic binary translator (DBT) system
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作者 杨吟冬 管海兵 《Journal of Central South University》 SCIE EI CAS 2012年第11期3118-3128,共11页
A new efficient adapting virtual intermediate instruction set,V-IIS,is designed and implemented towards the optimized dynamic binary translator (DBT) system.With the help of this powerful but previously little-studied... A new efficient adapting virtual intermediate instruction set,V-IIS,is designed and implemented towards the optimized dynamic binary translator (DBT) system.With the help of this powerful but previously little-studied component,DBTs can not only get rid of the dependence of machine(s),but also get better performance.From our systematical study and evaluation,experimental results demonstrate that if V-IIS is well designed,without affecting the other optimizing measures,this could make DBT's performance close to those who do not have intermediate instructions.This study is an important step towards the grand goal of high performance "multi-source" and "multi-target" dynamic binary translation. 展开更多
关键词 binary translation virtual intermediate instruction set dynamic binary translator (DBT)
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