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乱序超标量多核处理器的验证方法
被引量:
2
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作者
陈国华
《集成电路应用》
2019年第9期14-16,共3页
验证是芯片设计的关键环节,尤其对于高复杂度的处理器。阐述通用的处理器验证环境,紧密结合处理器设计中的关键点,提出了基于体系结构寄存器和多级缓存的验证原则,该方法应用于自主设计的X86通用处理器。
关键词
集成电路设计
处理器验证
体系结构寄存器
多级缓存
下载PDF
职称材料
题名
乱序超标量多核处理器的验证方法
被引量:
2
1
作者
陈国华
机构
上海兆芯集成电路有限公司
出处
《集成电路应用》
2019年第9期14-16,共3页
基金
工业和信息化部国家核高基专项基金(2014ZX-010291010)
文摘
验证是芯片设计的关键环节,尤其对于高复杂度的处理器。阐述通用的处理器验证环境,紧密结合处理器设计中的关键点,提出了基于体系结构寄存器和多级缓存的验证原则,该方法应用于自主设计的X86通用处理器。
关键词
集成电路设计
处理器验证
体系结构寄存器
多级缓存
Keywords
IC design
processor verification
architecture register
multi-level cache
分类号
TN402 [电子电信—微电子学与固体电子学]
TP332 [自动化与计算机技术—计算机系统结构]
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职称材料
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作者
出处
发文年
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1
乱序超标量多核处理器的验证方法
陈国华
《集成电路应用》
2019
2
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职称材料
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