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108位前导0计数器的电路设计与优化
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作者 李勇 秦海阳 李振涛 《微电子学与计算机》 CSCD 北大核心 2015年第4期1-4,9,共5页
采用2位分组进行并行分工计数,使用二叉树的电路结构进行108位前导0计数器电路设计.采用2位分组的108位前导0计数器电路进行PT分析的时序为0.17,而采用8位分组的RTL级代码进行DC综合的时序为0.21,通过比较发现设计电路在速度上比RTL级... 采用2位分组进行并行分工计数,使用二叉树的电路结构进行108位前导0计数器电路设计.采用2位分组的108位前导0计数器电路进行PT分析的时序为0.17,而采用8位分组的RTL级代码进行DC综合的时序为0.21,通过比较发现设计电路在速度上比RTL级代码快了19%. 展开更多
关键词 前导0设计理论 前导0电路设计 前导0电路优化 性能比较
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