一种低电压低静态电流LDO的电路设计

设计一种低电压低静态电流的线性差稳压器。传统结构的LDO具有独立的带隙基准电压源和误差放大器,在提出一种创新结构的LDO,把带隙基准电压源和误差放大器合二为一,因而实现了低静态电流消耗的目的。设计采用CSMC0.5μm双阱CMOS工艺进行仿真模拟,这种结构LDO在轻负载情况下静态电流仅为1.7μA,输出暂态电压最大变化为9 mV。