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基于FPGA的卫星导航抗干扰处理器设计 被引量:4
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作者 王达伟 李加琪 +1 位作者 吴嗣亮 王菊 《北京理工大学学报》 EI CAS CSCD 北大核心 2014年第3期299-303,共5页
为在现场可编程门阵列(FPGA)内实现整个数字抗干扰系统的功能,需要复用片内资源,设计了一种复浮点处理器(complex floating point processing unit,CFPU),简化了抗干扰算法在FPGA内实现的资源复用策略,使用了较少的硬件资源,解决了硬件... 为在现场可编程门阵列(FPGA)内实现整个数字抗干扰系统的功能,需要复用片内资源,设计了一种复浮点处理器(complex floating point processing unit,CFPU),简化了抗干扰算法在FPGA内实现的资源复用策略,使用了较少的硬件资源,解决了硬件资源紧张问题.仿真结果表明,当求解同一方程时,CFPU和TMS320C6713的单精度计算结果仅有微小差别,92MHz和176MHz的CFPU相对于200MHz工作频率的TMS320C6713分别有53.5和78.0倍的计算速度.室外实测抗干扰处理器有很好的抗干扰能力. 展开更多
关键词 卫星导航 抗干扰 复浮点处理器 流水线
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