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多核浮点非线性运算协处理器的设计与实现
被引量:
1
1
作者
马小霞
李文新
+2 位作者
金田
赵彦荣
夏加高
《计算机工程》
CAS
CSCD
北大核心
2017年第2期131-136,共6页
在载人航天飞船的终端仪器仪表设计中,处理算法中的浮点非线性运算常采用库函数实现,但软件实现非线性函数执行速度慢,限制了浮点算法的应用。为此,针对航天领域处理器不支持非线性函数运算的情况以及浮点算法执行速度慢的问题,提出一...
在载人航天飞船的终端仪器仪表设计中,处理算法中的浮点非线性运算常采用库函数实现,但软件实现非线性函数执行速度慢,限制了浮点算法的应用。为此,针对航天领域处理器不支持非线性函数运算的情况以及浮点算法执行速度慢的问题,提出一种多核并行执行浮点非线性运算处理方法,利用现场可编程门阵列内部并行架构带来的低延迟特性来提高非线性浮点运算的速度。仿真实验结果表明,该方法可计算有限定义域范围内的浮点非线性函数,有效提高浮点运算的执行速度。
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关键词
浮点数
多核运算协处理器
非线性函数
CORDIC算法
现场可编程门阵列
并行
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职称材料
题名
多核浮点非线性运算协处理器的设计与实现
被引量:
1
1
作者
马小霞
李文新
金田
赵彦荣
夏加高
机构
兰州空间技术物理研究所
出处
《计算机工程》
CAS
CSCD
北大核心
2017年第2期131-136,共6页
基金
载人航天重大工程专项
文摘
在载人航天飞船的终端仪器仪表设计中,处理算法中的浮点非线性运算常采用库函数实现,但软件实现非线性函数执行速度慢,限制了浮点算法的应用。为此,针对航天领域处理器不支持非线性函数运算的情况以及浮点算法执行速度慢的问题,提出一种多核并行执行浮点非线性运算处理方法,利用现场可编程门阵列内部并行架构带来的低延迟特性来提高非线性浮点运算的速度。仿真实验结果表明,该方法可计算有限定义域范围内的浮点非线性函数,有效提高浮点运算的执行速度。
关键词
浮点数
多核运算协处理器
非线性函数
CORDIC算法
现场可编程门阵列
并行
Keywords
floating-point numbers
multicore operation coprocessor
nonlinear functions
CORDIC algorithm
Field-Programmable Gate Array(FPGA)
parallel
分类号
TP332 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
多核浮点非线性运算协处理器的设计与实现
马小霞
李文新
金田
赵彦荣
夏加高
《计算机工程》
CAS
CSCD
北大核心
2017
1
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