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题名在多电源多电压的时代符合UPF单元库/环境
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作者
蔡旭回
黄坤进
陈宏铭
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机构
智原科技(上海)有限公司
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出处
《中国集成电路》
2010年第3期55-58,共4页
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文摘
各式各样的低功耗设计技术需要被使用来降低设备的功耗,进而增加电池的使用寿命。芯片设计的每个步骤都需要低功耗方案,如何有效地设计与管理这些复杂的低功耗方案成为了一个至关重要的课题。本文我们将回顾传统多电源多电压设计流程,然后与基于统一功率格式方法学做一个比较。稍后,我们将介绍专用单元库的需求以及分享一些我们对统一功率格式方法学的看法。
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关键词
低功耗设计
多电源多电压单元库的环境
统一功率格式
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Keywords
Low Power Design, Multi-Supply Muhi-Vohage
Unified Power Format
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分类号
TN402
[电子电信—微电子学与固体电子学]
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题名一种低功耗系统芯片的可测试性设计方案
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作者
徐太龙
鲁世斌
代广珍
孟坚
陈军宁
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机构
安徽大学电子信息工程学院安徽省集成电路设计实验室
合肥师范学院电子信息工程学院
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出处
《计算机工程》
CAS
CSCD
2014年第3期306-309,共4页
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基金
安徽大学青年科学研究基金资助项目(KJQN1011)
安徽大学青年骨干教师培养基金资助项目(33010224)
+1 种基金
安徽省高校优秀青年人才基金资助项目(2012SQRL013ZD)
安徽省高等学校省级自然科学研究基金资助项目(KJ2012B143)
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文摘
低功耗技术,如多电源多电压和电源关断等的应用,给现代超大规模系统芯片可测试性设计带来诸多问题。为此,采用工业界认可的电子设计自动化工具和常用的测试方法,构建实现可测试性设计的高效平台。基于该平台,提出一种包括扫描链设计、嵌入式存储器内建自测试和边界扫描设计的可测性设计实现方案。实验结果表明,该方案能高效、方便和准确地完成低功耗系统芯片的可测性设计,并成功地在自动测试仪上完成各种测试,组合逻辑和时序逻辑的扫描链测试覆盏率为98.2%。
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关键词
可测试性设计
低功耗
系统芯片
内建自测试
电源关断
多电源多电压
扫描链
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Keywords
testability design
low power consumption
System-on-chip(SoC)
built-in-self-test
Power Shut-off(PSO)
Multi-supplyMulti-voltage(MSMV)
scan chain
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分类号
TN47
[电子电信—微电子学与固体电子学]
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题名一种低功耗系统芯片的实现流程
被引量:1
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作者
徐太龙
孟坚
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机构
安徽大学电子信息工程学院
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出处
《电子技术(上海)》
2010年第12期74-75,共2页
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基金
安徽省集成电路设计平台基金项目
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文摘
随着半导体工艺技术的进步,系统芯片的集成度越来越高,功耗成为重点考虑的因素之一,尤其用于便携式设备中。本文描述了一种多电源、多电压低功耗系统芯片的实现流程。该流程基于IEEE1801(UPF)标准,采用Synopsys和Mentor Graphics公司的EDA工具,方便地实现了RTL-GDSII的整个过程。
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关键词
低功耗
可测性设计
多电源多电压
电源关断
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Keywords
low power consumption
testability design
multi-supply multi-voltage
power gating
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分类号
TN01
[电子电信—物理电子学]
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