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基于MATLAB的新型Pipeline ADC的建模和仿真
被引量:
4
1
作者
李萌
张润曦
+3 位作者
陈磊
沈佳铭
陈文斌
赖宗声
《电子器件》
CAS
2008年第3期834-837,共4页
在MATLAB/Simulink的平台上,设计并实现了一种新的10bit Pipeline ADC的系统仿真模型。针对2bit,共9级的结构的精度不足以及4bit首级结构的功耗较大的特点,提出了一种首级3bit,共8级的结构。这种结构可以实现精度和功耗的平衡。经过系...
在MATLAB/Simulink的平台上,设计并实现了一种新的10bit Pipeline ADC的系统仿真模型。针对2bit,共9级的结构的精度不足以及4bit首级结构的功耗较大的特点,提出了一种首级3bit,共8级的结构。这种结构可以实现精度和功耗的平衡。经过系统仿真,在输入信号为10MHz,采样时钟频率为40MHz时,系统最大的SNR=60.6dB,SFDR=82.177dB。创建的系统模型可为ADC系统中的误差和静态特性研究提供借鉴。
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关键词
流水线结构的模数转换器
3bit结构
增益
误差
子adc误差
子
DAC(位数模转换器)
误差
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职称材料
题名
基于MATLAB的新型Pipeline ADC的建模和仿真
被引量:
4
1
作者
李萌
张润曦
陈磊
沈佳铭
陈文斌
赖宗声
机构
华东师范大学微电子电路与系统研究所
出处
《电子器件》
CAS
2008年第3期834-837,共4页
基金
上海市AM基金资助(AM0508)(AM0513)
上海市科委资助(06SA14)
文摘
在MATLAB/Simulink的平台上,设计并实现了一种新的10bit Pipeline ADC的系统仿真模型。针对2bit,共9级的结构的精度不足以及4bit首级结构的功耗较大的特点,提出了一种首级3bit,共8级的结构。这种结构可以实现精度和功耗的平衡。经过系统仿真,在输入信号为10MHz,采样时钟频率为40MHz时,系统最大的SNR=60.6dB,SFDR=82.177dB。创建的系统模型可为ADC系统中的误差和静态特性研究提供借鉴。
关键词
流水线结构的模数转换器
3bit结构
增益
误差
子adc误差
子
DAC(位数模转换器)
误差
Keywords
pipeline
adc
3 bit architectures gain error
error in sub-
adc
error in sub-DAC
分类号
TN602 [电子电信—电路与系统]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于MATLAB的新型Pipeline ADC的建模和仿真
李萌
张润曦
陈磊
沈佳铭
陈文斌
赖宗声
《电子器件》
CAS
2008
4
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职称材料
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参考文献
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