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超深亚微米层次互连特性及其布局布线优化(英文)
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作者 薛振华 李惠军 《微纳电子技术》 CAS 2004年第12期45-49,共5页
随着集成电路特征尺寸进入超深亚微米层次,互连线开始成为制约系统功能和可靠性的决定性因素。本文介绍了布局布线中的几种优化步骤:拥挤驱动布局、局部布局和搜索提炼、轨道分配和搜索修补。并结合Synopsys公司的超深亚微米布局布线系... 随着集成电路特征尺寸进入超深亚微米层次,互连线开始成为制约系统功能和可靠性的决定性因素。本文介绍了布局布线中的几种优化步骤:拥挤驱动布局、局部布局和搜索提炼、轨道分配和搜索修补。并结合Synopsys公司的超深亚微米布局布线系统APOLLO-Ⅱ有效地解决了互连线的串扰噪声和破坏问题。 展开更多
关键词 超深亚微米 层次互连 布局布线 集成电路
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基于参数的层次化Mesh互连片上网络结构 被引量:2
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作者 简刚 韩国栋 +1 位作者 马钊坤 周玉瀚 《计算机应用研究》 CSCD 北大核心 2016年第6期1857-1861,共5页
提出一种基于参数的层次化Mesh互连片上网络结构——PHNo C,解决片上网络规模扩张引起的通信延迟和吞吐性能下降问题。采用分簇多层次互连的思想,提高片上网络扩展性和连通性;引入层数和分簇类型参数,实现不同网络规模的灵活配置;引入... 提出一种基于参数的层次化Mesh互连片上网络结构——PHNo C,解决片上网络规模扩张引起的通信延迟和吞吐性能下降问题。采用分簇多层次互连的思想,提高片上网络扩展性和连通性;引入层数和分簇类型参数,实现不同网络规模的灵活配置;引入跨层流控参数,控制并平衡层间负载流量。仿真实验表明,在多种流量模式下,不同网络规模时,PHNo C结构的延迟和吞吐性能相比传统的平面或两层结构优势明显,而资源开销和实现复杂度增加不大,说明增加多层互连资源可有效换取通信性能的提高。 展开更多
关键词 片上网络 参数化设计 分簇结构 层次互连
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互连性层次聚类法在交易数据聚类分析中的应用
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作者 陆楠 周春光 《深圳大学学报(理工版)》 EI CAS 2003年第1期63-69,共7页
提出一种使用互连性度量聚类间相似度的层次聚类算法 ,并对算法中较为耗时的两步进行了修改 ,在不牺牲质量的前提下 ,提高了算法的运行速度 .通过分析交易数据的实际聚类 ,可得到合理的市场分段 ,预测顾客购买行为 .实验结果表明 ,该方... 提出一种使用互连性度量聚类间相似度的层次聚类算法 ,并对算法中较为耗时的两步进行了修改 ,在不牺牲质量的前提下 ,提高了算法的运行速度 .通过分析交易数据的实际聚类 ,可得到合理的市场分段 ,预测顾客购买行为 .实验结果表明 ,该方法具有良好的挖掘效果 . 展开更多
关键词 互连层次聚类法 数据挖掘 交易数据 聚类分析 相似度
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参数分簇层次化片上网络拓扑结构 被引量:2
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作者 简刚 韩国栋 +1 位作者 马钊坤 周玉瀚 《信息工程大学学报》 2016年第3期346-352,共7页
多核系统集成度不断增加,造成片上网络的延迟和吞吐性能迅速下降。提出基于参数分簇的层次化片上网络结构,设计3类基本分簇作为单元模块,搭建不同节点规模下的层次化结构。实验结果表明,在局部化流量模式下,文中结构比传统Mesh和Cluster... 多核系统集成度不断增加,造成片上网络的延迟和吞吐性能迅速下降。提出基于参数分簇的层次化片上网络结构,设计3类基本分簇作为单元模块,搭建不同节点规模下的层次化结构。实验结果表明,在局部化流量模式下,文中结构比传统Mesh和Clustered Hierarchical Mesh在256节点时的延迟分别降低18.76%和17.31%,吞吐提升18.57%和12.97%,资源仅增加25%和10%。 展开更多
关键词 片上网络 层次互连 分簇结构 参数化设计
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Recursive bisection placement algorithm with the predicted wirelength
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作者 蒿杰 马鸿 彭思龙 《Journal of Southeast University(English Edition)》 EI CAS 2008年第4期462-467,共6页
To obtain a better placement result, a partitioning-based placement algorithm with wirelength prediction called HJ-Pl is presented. A new method is proposed to estimate proximity of interconnects in a netlist, which i... To obtain a better placement result, a partitioning-based placement algorithm with wirelength prediction called HJ-Pl is presented. A new method is proposed to estimate proximity of interconnects in a netlist, which is capable of predicting not only short interconnects but long interconnects accurately. The predicted wirelength is embedded into the partitioning tool of bisection-based global placement, which can guide our placement towards a solution with shorter interconnects. In addition, the timing objective can be handled within the algorithm by minimizing the critical path delay. Experimental results show that, compared to Capol0. 5, mPL6, and NTUplace, HJ-P1 outperforms these placers in terms of wirelength and run time. The improvements in terms of average wirelength over Capo10. 5, mPL6 and NPUplace are 13%, 3%, and 9% with only 19%, 91%, and 99% of their runtime, respectively. By integrating the predicted wirelength-driven clustering into Capo10. 5, the placer is able to reduce average wirelength by 3%. The timing-driven HJ-P1 can reduce the critical path delay by 23%. 展开更多
关键词 HIERARCHY INTERCONNECT PLACEMENT VLSI circuit wirelength prediction
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