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串扰约束下超深亚微米顶层互连线性能的优化设计
被引量:
4
1
作者
王颀
单智阳
+1 位作者
朱云涛
邵丙铣
《电子学报》
EI
CAS
CSCD
北大核心
2006年第2期214-219,共6页
优化顶层互连线性能已成为超深亚微米片上系统(SOC)设计的关键.本文提出了适用于多个工艺节点的串扰约束下顶层互连线性能的优化方法.该方法由基于分布RLC连线模型的延迟串扰解析公式所推得.通过HSPICE仿真验证,对当前主流工艺(90nm),...
优化顶层互连线性能已成为超深亚微米片上系统(SOC)设计的关键.本文提出了适用于多个工艺节点的串扰约束下顶层互连线性能的优化方法.该方法由基于分布RLC连线模型的延迟串扰解析公式所推得.通过HSPICE仿真验证,对当前主流工艺(90nm),此优化方法可令与芯片边长等长的顶层互连线(23.9mm)的延时减小到182ps,数据总线带宽达到1.43 GHz/μm,近邻连线峰值串扰电压控制在0.096Vdd左右.通过由本方法所确定的各工艺节点下的截面参数和性能指标,可合理预测未来超深亚微米工艺条件下顶层互连线优化设计的发展趋势.
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关键词
顶层互连线设计
分布RLC模型
连线串扰
延时带宽因子
下载PDF
职称材料
题名
串扰约束下超深亚微米顶层互连线性能的优化设计
被引量:
4
1
作者
王颀
单智阳
朱云涛
邵丙铣
机构
复旦大学国家微电子材料与元器件微分析中心
出处
《电子学报》
EI
CAS
CSCD
北大核心
2006年第2期214-219,共6页
文摘
优化顶层互连线性能已成为超深亚微米片上系统(SOC)设计的关键.本文提出了适用于多个工艺节点的串扰约束下顶层互连线性能的优化方法.该方法由基于分布RLC连线模型的延迟串扰解析公式所推得.通过HSPICE仿真验证,对当前主流工艺(90nm),此优化方法可令与芯片边长等长的顶层互连线(23.9mm)的延时减小到182ps,数据总线带宽达到1.43 GHz/μm,近邻连线峰值串扰电压控制在0.096Vdd左右.通过由本方法所确定的各工艺节点下的截面参数和性能指标,可合理预测未来超深亚微米工艺条件下顶层互连线优化设计的发展趋势.
关键词
顶层互连线设计
分布RLC模型
连线串扰
延时带宽因子
Keywords
design of global interconnect
distributed RLC model
interconnect crosstalk
delay-bandwidth factor
分类号
TN454 [电子电信—微电子学与固体电子学]
下载PDF
职称材料
题名
作者
出处
发文年
被引量
操作
1
串扰约束下超深亚微米顶层互连线性能的优化设计
王颀
单智阳
朱云涛
邵丙铣
《电子学报》
EI
CAS
CSCD
北大核心
2006
4
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职称材料
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