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FPGA芯片时钟架构分析
被引量:
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作者
张艳飞
谢长生
匡晨光
《电子与封装》
2016年第6期28-30,共3页
FPGA设计中时钟信号的设计与处理是保证系统稳定工作的重要组成部分,随着FPGA器件规模的不断增大,集成度不断提高,多时钟域管理、时钟延迟、时钟信号完整性和相位偏移等已成为影响FPGA设计的关键因素。结合微电子电路相关知识,针对Xilin...
FPGA设计中时钟信号的设计与处理是保证系统稳定工作的重要组成部分,随着FPGA器件规模的不断增大,集成度不断提高,多时钟域管理、时钟延迟、时钟信号完整性和相位偏移等已成为影响FPGA设计的关键因素。结合微电子电路相关知识,针对Xilinx公司的Virtex4系列芯片,详细分析其时钟架构及时钟资源的特性。针对FPGA时钟设计的典型应用情况,从芯片角度给出了时钟设计与使用的一些技巧和建议。
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关键词
现场可编程门阵列
时钟架构
时钟
管理
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题名
FPGA芯片时钟架构分析
被引量:
1
1
作者
张艳飞
谢长生
匡晨光
机构
中国电子科技集团公司第
无锡中微亿芯有限公司
出处
《电子与封装》
2016年第6期28-30,共3页
文摘
FPGA设计中时钟信号的设计与处理是保证系统稳定工作的重要组成部分,随着FPGA器件规模的不断增大,集成度不断提高,多时钟域管理、时钟延迟、时钟信号完整性和相位偏移等已成为影响FPGA设计的关键因素。结合微电子电路相关知识,针对Xilinx公司的Virtex4系列芯片,详细分析其时钟架构及时钟资源的特性。针对FPGA时钟设计的典型应用情况,从芯片角度给出了时钟设计与使用的一些技巧和建议。
关键词
现场可编程门阵列
时钟架构
时钟
管理
Keywords
FPGA
clock architecture
clock management
分类号
TN402 [电子电信—微电子学与固体电子学]
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作者
出处
发文年
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1
FPGA芯片时钟架构分析
张艳飞
谢长生
匡晨光
《电子与封装》
2016
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