FIR数字滤波器的优化设计

针对常系数FIR数字滤波器,采用CSD编码和简化加法器图技术来减少FIR实现过程中乘累运算的加减次数,从而降低了其对硬件资源的消耗;在结构上采用分布式算法和流水线技术进行优化,显著的提高了FIR数字滤波器的工作速度。通过实例对每一种改进方法进行了对比验证,说明达到了节省芯片资源或提高实现频率的目的。

用FPGA实现FIR数字滤波器的新方法

在介绍用FPGA设计FIR数字滤波器常用的正则有符号数字量(CSD)编码技术和分布式算法(DA)的基础上,提出了一种改进的实现方法.该方法根据滤波器系数的特点将滤波器分为两个部分,一部分采用CSD编码技术设计,一部分采用DA算法设计.通过Quartus2软件仿真,在Cyclone EPEC6Q240C8芯片上实现了多个FIR数字滤波器.实验结果表明:改进的实现方法在一般情况下更加节约芯片面积,且实现的FIR数字滤波器完全达到了性能要求.

宽带通信芯片中级联积分梳状插值滤波器的优化设计

级联积分梳状(CIC)滤波器由于其结构简单、高效等优点,经常作为宽带通信芯片中的抽取器或插值器。随着通信系统以及超大规模集成电路的发展,芯片集成密度越来越高,需要对芯片中关键模块积分梳状滤波器进行面积的优化。为此,设计一种应用于无线宽带射频芯片的CIC插值滤波器。通过位宽优化方法减少滤波器内部节点位宽,并在增益校正部分采用输出截位后的正则有符号数字量编码乘法代替全位宽二进制补码乘法。实验结果表明,与优化前的CIC插值滤波器相比,该滤波器的电路面积可优化58%左右。

一种基于FPGA的高效FIR滤波器的设计与实现

该文在介绍有限冲激响应(FIR)数字滤波器理论及常见实现方法的基础上,提出了一种基于FPGA的高效实现方案。该方案采用对称结构、加法和移位代替乘法运算、优化的CSD编码、流水线和级联技术等方面对传统的设计方法进行了改进,并借助FPGA滤波器芯片和Qu-artusⅡ软件、Matlab软件对该方案进行了仿真验证。仿真实验结果表明:此种FIR滤波器的实现方法运算速度快、实时性好、节省硬件资源,其性能优于传统的FIR滤波器设计方法。

常系数乘法器的VLSI高效设计

符号数的正则表示(CSD)是一种用最少的非零比特位来表示符号数的编码技术。介绍了一种基于二进制补码数实现CSD编码的转换算法。通过采用多种优化技术,提出了基于CSD编码技术的常系数乘法器的VL-SI高效设计。采用Verilog硬件描述语言实现了一组小波滤波器的乘法单元的RTL描述,在XilinxISE4.1环境下对设计进行了功能仿真、综合和FPGA原型实现。

信道化结构的无乘法器优化与实现

针对宽带接收机在拥有大的动态范围与高灵敏度的同时需要降低资源占用的问题,基于多相滤波信道化结构和频率响应屏蔽技术,将正则有符号数编码技术和改进动态旋转因子算法用于无乘法器的信道化结构优化设计中,将乘法器资源的占用转化为移位器与加法器的占用,提高硬件实现的效率、降低延迟。仿真结果表明:无乘法器算法可以有效地降低乘法器资源占用,提高信号处理性能。

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1来稿要求(1)题名不超过20个字,尽量不用标点符号和副标题。立题要有新意。如系课题文章,请标注课题名称、级别和编号。课题如若获奖请及时反馈我刊。学生作者论文涉及导师学术思想等内容需经导师审查、签字。(2)按顺序写清楚每位作者的姓名。

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《北京中医药大学学报(中医临床版)》是由教育部主管、北京中医药大学主办的中央级高级中医药学术期刊。主编为中国中医界学术权威王永炎院士。办刊宗旨是继承弘扬中国传统医药文化,宣传中医药临床应用,为中医药教学、科研、医疗服务。主要面向国内外医学院校的师生,各级各类医院的临床医生,以及有关专业的人员等。

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