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电源关断技术在导航芯片的物理设计实现 被引量:1
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作者 孟少鹏 马强 《中国集成电路》 2014年第4期32-36,共5页
本文通过Cadence公司的EDI平台介绍了电源关断的物理设计流程,采用CPF文件定义了电源关断意图和功耗约束。通过对一款导航测试芯片采用电源关断技术,完成物理设计流程,并对芯片关断前后的漏电功耗进行了仿真分析。分析结果表明,采用电... 本文通过Cadence公司的EDI平台介绍了电源关断的物理设计流程,采用CPF文件定义了电源关断意图和功耗约束。通过对一款导航测试芯片采用电源关断技术,完成物理设计流程,并对芯片关断前后的漏电功耗进行了仿真分析。分析结果表明,采用电源关断技术,可以有效的降低芯片的漏电功耗。 展开更多
关键词 电源关断 物理设计 CPF
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采用电源关断技术芯片的设计实现 被引量:1
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作者 王殿超 易兴勇 潘亮 《中国集成电路》 2010年第3期63-68,共6页
电源关断(PSO)技术是指芯片中某些模块在一段时间内不工作时,将其供电电源关断,从而达到降低芯片静态功耗的目的。本文通过采用Cadence公司的CPF格式来定义各个低功耗单元,通过一个芯片设计实例,介绍了电源关断的实现过程。流片后的测... 电源关断(PSO)技术是指芯片中某些模块在一段时间内不工作时,将其供电电源关断,从而达到降低芯片静态功耗的目的。本文通过采用Cadence公司的CPF格式来定义各个低功耗单元,通过一个芯片设计实例,介绍了电源关断的实现过程。流片后的测试结果表明,采用电源关断技术,可以有效的降低芯片的静态功耗。 展开更多
关键词 低功耗设计 电源关断 CPF格式
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一种I2C异步低功耗唤醒电路
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作者 闫志锋 蒙卡娜 周永存 《中国集成电路》 2024年第10期52-55,共4页
芯片设计中,为了降低芯片功耗,会将芯片划分为多个电源域。在芯片进入低功耗模式时,将不工作的电源域掉电,仅保留必须的电源域带电,达到降低芯片功耗的目的。芯片进入低功耗模式后,主机要和芯片通信,需要先将芯片退出低功耗模式,然后才... 芯片设计中,为了降低芯片功耗,会将芯片划分为多个电源域。在芯片进入低功耗模式时,将不工作的电源域掉电,仅保留必须的电源域带电,达到降低芯片功耗的目的。芯片进入低功耗模式后,主机要和芯片通信,需要先将芯片退出低功耗模式,然后才能正常通信。I2C作为主机和芯片间常用的通信的接口,是一种常用的芯片退低功耗模式唤醒源。常用的I2C唤醒电路中,采用同步电路方式,需要额外的一个高频时钟,用来采样SDA和SCL信号,识别到I2C的起始信号后,唤醒芯片。这种同步唤醒电路,高频采样时钟在低功耗模式期间需要一直工作,增加了唤醒电路的功耗,同时由于只检测START信号,会存在误唤醒的情况。本文介绍了一种I2C异步唤醒电路,该电路不需要高频时钟,也可避免误唤醒的发生。 展开更多
关键词 异步 唤醒 接口 低功耗 电源 电源关断
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ADI ADuM4146米勒箝位的单/双电源高电压隔离SiC栅极驱动方案
4
《世界电子元器件》 2022年第6期51-54,共4页
ADI公司的ADuM4146是款单通道栅极驱动器,专门针对驱动碳化硅(SiC)金属氧化物半导体场效应晶体管(MOSFET)进行了优化.ADI公司的iCoupler®技术在输入信号与输出栅极驱动器之间实现隔离.ADuM4146包含米勒箝位,以便栅极电压低于2 V时... ADI公司的ADuM4146是款单通道栅极驱动器,专门针对驱动碳化硅(SiC)金属氧化物半导体场效应晶体管(MOSFET)进行了优化.ADI公司的iCoupler®技术在输入信号与输出栅极驱动器之间实现隔离.ADuM4146包含米勒箝位,以便栅极电压低于2 V时实现稳健的SiC单轨电源关断.输出侧可以由单电源或双电源供电,是否使能米勒箝位功能也可以进行配置. 展开更多
关键词 栅极驱动 电源供电 电源关断 电源 栅极电压 箝位 输出侧
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一种低功耗系统芯片的可测试性设计方案
5
作者 徐太龙 鲁世斌 +2 位作者 代广珍 孟坚 陈军宁 《计算机工程》 CAS CSCD 2014年第3期306-309,共4页
低功耗技术,如多电源多电压和电源关断等的应用,给现代超大规模系统芯片可测试性设计带来诸多问题。为此,采用工业界认可的电子设计自动化工具和常用的测试方法,构建实现可测试性设计的高效平台。基于该平台,提出一种包括扫描链设计、... 低功耗技术,如多电源多电压和电源关断等的应用,给现代超大规模系统芯片可测试性设计带来诸多问题。为此,采用工业界认可的电子设计自动化工具和常用的测试方法,构建实现可测试性设计的高效平台。基于该平台,提出一种包括扫描链设计、嵌入式存储器内建自测试和边界扫描设计的可测性设计实现方案。实验结果表明,该方案能高效、方便和准确地完成低功耗系统芯片的可测性设计,并成功地在自动测试仪上完成各种测试,组合逻辑和时序逻辑的扫描链测试覆盏率为98.2%。 展开更多
关键词 可测试性设计 低功耗 系统芯片 内建自测试 电源关断 电源多电压 扫描链
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CSP多核处理器芯片的低功耗设计
6
作者 高军 王永文 +1 位作者 郭维 黄安文 《上海交通大学学报》 EI CAS CSCD 北大核心 2013年第1期118-122,128,共6页
提出了3种高主频多核处理器CSP芯片的功耗优化技术,即电源域间隔关断技术、流量感知的动态频率调节技术和层次式门控时钟技术.结果表明,3种优化技术对降低芯片功耗的作用均非常有效,能够不同程度地降低芯片的总功耗.其中,电源域间隔关... 提出了3种高主频多核处理器CSP芯片的功耗优化技术,即电源域间隔关断技术、流量感知的动态频率调节技术和层次式门控时钟技术.结果表明,3种优化技术对降低芯片功耗的作用均非常有效,能够不同程度地降低芯片的总功耗.其中,电源域间隔关断技术能够解决静态漏流功耗,流量感知的动态频率调节技术和层次式门控时钟技术能够控制动态功耗. 展开更多
关键词 芯片 功耗 电源关断 动态频率调节 门控时钟
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对PSO结构的设计与优化
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作者 严伟 时广轶 常莹 《电子制作》 2016年第1X期27-27,共1页
本文基于低功耗电源门控技术,提出了通过分簇的方式改变PSO安放结构,并对局部的PSO采取常关的一个状态。进一步减小门控单元本身的消耗功率。本文中对整个电源门控分簇,采用的中等粒度的插入方式,得到了三种关键因素同时优化的结果。
关键词 电源关断 IR 压降 功耗
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一种基于CPF格式的低功耗物理设计方法与实现 被引量:1
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作者 谢旦杰 魏敬和 于宗光 《微电子学与计算机》 北大核心 2019年第3期87-90,共4页
本文提出了一种基于CPF格式的低功耗物理设计流程,将低功耗设计意图、电源信息、约束条件等整合到CPF文件中,并且可以用于集成电路设计流程的各个阶段,保证了设计的高效性与一致性.针对一款MCU电路,结合CPF文件,采用多供电电压和电源关... 本文提出了一种基于CPF格式的低功耗物理设计流程,将低功耗设计意图、电源信息、约束条件等整合到CPF文件中,并且可以用于集成电路设计流程的各个阶段,保证了设计的高效性与一致性.针对一款MCU电路,结合CPF文件,采用多供电电压和电源关断的低功耗技术对其进行物理设计实现.最终软件分析结果表明,电压降和功耗满足设计要求. 展开更多
关键词 低功耗 CPF 多供电电压 电源关断
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龙口广播电视台机房大屏幕监播控制系统 被引量:1
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作者 战永臣 刘守强 +1 位作者 杨继志 朱德国 《有线电视技术》 2006年第11期70-73,共4页
本文从龙口市广播电视台的实际情况出发,详细论述了机房大屏幕监播控制系统的用户需要分析,从系统的设计、功能、实施等多方面阐述了该系统的应用情况。
关键词 大屏幕 监播 监控 自动控制 电源关断
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基于Bittop的统一功率格式定义
10
作者 刘东明 张宇涵 《电气开关》 2021年第1期69-71,共3页
集成电路作为推动信息产业发展与进步的新兴力量,正在迅猛发展,而低功耗技术已经成为数字集成电路设计过程中的重点考量。本文基于采用SMIC 55nm工艺进行层次化综合与物理设计的IP核Bittop,使用统一功率格式文件定义其多电压设计意图,... 集成电路作为推动信息产业发展与进步的新兴力量,正在迅猛发展,而低功耗技术已经成为数字集成电路设计过程中的重点考量。本文基于采用SMIC 55nm工艺进行层次化综合与物理设计的IP核Bittop,使用统一功率格式文件定义其多电压设计意图,并利用工具PrimeTime PX分析Bittop在采用多电压供电与电源关断技术后的功耗优化情况。 展开更多
关键词 Bittop 统一功率格式 多电压供电与电源关断技术 PrimeTime PX
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一种低功耗系统芯片的实现流程 被引量:1
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作者 徐太龙 孟坚 《电子技术(上海)》 2010年第12期74-75,共2页
随着半导体工艺技术的进步,系统芯片的集成度越来越高,功耗成为重点考虑的因素之一,尤其用于便携式设备中。本文描述了一种多电源、多电压低功耗系统芯片的实现流程。该流程基于IEEE1801(UPF)标准,采用Synopsys和Mentor Graphics公司的... 随着半导体工艺技术的进步,系统芯片的集成度越来越高,功耗成为重点考虑的因素之一,尤其用于便携式设备中。本文描述了一种多电源、多电压低功耗系统芯片的实现流程。该流程基于IEEE1801(UPF)标准,采用Synopsys和Mentor Graphics公司的EDA工具,方便地实现了RTL-GDSII的整个过程。 展开更多
关键词 低功耗 可测性设计 电源多电压 电源关断
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