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基于通用开关盒的FPGA互连结构低功耗设计
1
作者
邵海波
马珂洁
王伶俐
《复旦学报(自然科学版)》
CAS
CSCD
北大核心
2012年第1期63-70,共8页
为了降低FPGA互连结构的功耗,针对目前FPGA普遍采用的通用互连结构,提出了快速结构评估框架—FDPAef,建立了功耗延时积的逐级优化步骤.在新型的通用开关盒互连结构(GSB)基础上,使用该评估框架对各种结构参数进行评估和优化,得到一种低...
为了降低FPGA互连结构的功耗,针对目前FPGA普遍采用的通用互连结构,提出了快速结构评估框架—FDPAef,建立了功耗延时积的逐级优化步骤.在新型的通用开关盒互连结构(GSB)基础上,使用该评估框架对各种结构参数进行评估和优化,得到一种低功耗的GSB结构.经过MCNC基准电路测试实验表明,相比传统的CB/SB互连结构,优化得到的GSB结构能够使FPGA功耗延时积下降9.9%,面积下降10.7%.
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关键词
现场可编程门阵列
通用开关盒
结构评估框架
互连
结构
功耗延时积
原文传递
题名
基于通用开关盒的FPGA互连结构低功耗设计
1
作者
邵海波
马珂洁
王伶俐
机构
复旦大学专用集成电路与系统国家重点实验室
出处
《复旦学报(自然科学版)》
CAS
CSCD
北大核心
2012年第1期63-70,共8页
基金
上海市科学技术委员会基金(08706200101)资助项目
文摘
为了降低FPGA互连结构的功耗,针对目前FPGA普遍采用的通用互连结构,提出了快速结构评估框架—FDPAef,建立了功耗延时积的逐级优化步骤.在新型的通用开关盒互连结构(GSB)基础上,使用该评估框架对各种结构参数进行评估和优化,得到一种低功耗的GSB结构.经过MCNC基准电路测试实验表明,相比传统的CB/SB互连结构,优化得到的GSB结构能够使FPGA功耗延时积下降9.9%,面积下降10.7%.
关键词
现场可编程门阵列
通用开关盒
结构评估框架
互连
结构
功耗延时积
Keywords
FPGA
general switch box
architecture evalution framework
interconnect architecture
power delay product
分类号
TN402 [电子电信—微电子学与固体电子学]
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题名
作者
出处
发文年
被引量
操作
1
基于通用开关盒的FPGA互连结构低功耗设计
邵海波
马珂洁
王伶俐
《复旦学报(自然科学版)》
CAS
CSCD
北大核心
2012
0
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