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高速CMOS钟控比较器的设计
被引量:
3
1
作者
段吉海
覃宇飞
潘磊
《电子器件》
CAS
2010年第2期158-161,共4页
基于预放大锁存理论,设计了一种高速钟控比较器,它包括三个主要部分:预放大器、判断级电路、输出缓冲器。在SMIC 0.18μm CMOS工艺模型和1.8 V电源电压下,采用Hspice对比较器电路进行仿真,结果表明在500 MHz的时钟频率下,精度可达0.3 mV...
基于预放大锁存理论,设计了一种高速钟控比较器,它包括三个主要部分:预放大器、判断级电路、输出缓冲器。在SMIC 0.18μm CMOS工艺模型和1.8 V电源电压下,采用Hspice对比较器电路进行仿真,结果表明在500 MHz的时钟频率下,精度可达0.3 mV,功耗仅为26.6μW。该电路可以应用在高速Flash ADC电路中。
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关键词
钟控比较器
预
放大器
正反馈
自偏置差分放大器
失调电压
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职称材料
题名
高速CMOS钟控比较器的设计
被引量:
3
1
作者
段吉海
覃宇飞
潘磊
机构
桂林电子科技大学信息与通信学院
出处
《电子器件》
CAS
2010年第2期158-161,共4页
基金
UWB多点协同定位
国家自然科学基金
+1 种基金
TH-UWB通信专用集成电路研究
广西科学基金
文摘
基于预放大锁存理论,设计了一种高速钟控比较器,它包括三个主要部分:预放大器、判断级电路、输出缓冲器。在SMIC 0.18μm CMOS工艺模型和1.8 V电源电压下,采用Hspice对比较器电路进行仿真,结果表明在500 MHz的时钟频率下,精度可达0.3 mV,功耗仅为26.6μW。该电路可以应用在高速Flash ADC电路中。
关键词
钟控比较器
预
放大器
正反馈
自偏置差分放大器
失调电压
Keywords
clocked comparator
preamplifier
positive feedback
self-biasing differential amplifier
offset voltage
分类号
TN432 [电子电信—微电子学与固体电子学]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
高速CMOS钟控比较器的设计
段吉海
覃宇飞
潘磊
《电子器件》
CAS
2010
3
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职称材料
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