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衬底寄生电阻对高压器件ESD性能的影响
被引量:
1
1
作者
林丽娟
喻钊
+2 位作者
韩山明
蒋苓利
张波
《微电子学》
CAS
CSCD
北大核心
2011年第5期766-769,共4页
随着高压集成电路的广泛应用,高压器件的ESD性能越来越受广大设计者的重视。从理论上分析了衬底寄生电阻对高压LDMOS器件ESD特性的影响,采用几种结构,对上述参数进行优化,并在0.35μm BCD工艺下进行流片试验。测试结果表明,优化衬底电...
随着高压集成电路的广泛应用,高压器件的ESD性能越来越受广大设计者的重视。从理论上分析了衬底寄生电阻对高压LDMOS器件ESD特性的影响,采用几种结构,对上述参数进行优化,并在0.35μm BCD工艺下进行流片试验。测试结果表明,优化衬底电阻可以有效地提高器件的ESD泄放能力,最优结构的二次击穿电流由原始器件的0.75A增大到3.3A。
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关键词
ESD
高压器件
衬底寄生电阻
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职称材料
题名
衬底寄生电阻对高压器件ESD性能的影响
被引量:
1
1
作者
林丽娟
喻钊
韩山明
蒋苓利
张波
机构
电子科技大学电子薄膜与集成器件国家重点实验室
出处
《微电子学》
CAS
CSCD
北大核心
2011年第5期766-769,共4页
基金
国家自然科学基金资助项目(60906038)
文摘
随着高压集成电路的广泛应用,高压器件的ESD性能越来越受广大设计者的重视。从理论上分析了衬底寄生电阻对高压LDMOS器件ESD特性的影响,采用几种结构,对上述参数进行优化,并在0.35μm BCD工艺下进行流片试验。测试结果表明,优化衬底电阻可以有效地提高器件的ESD泄放能力,最优结构的二次击穿电流由原始器件的0.75A增大到3.3A。
关键词
ESD
高压器件
衬底寄生电阻
Keywords
ESD
High-voltage device
Substrate parasitic resistance
分类号
TN406 [电子电信—微电子学与固体电子学]
下载PDF
职称材料
题名
作者
出处
发文年
被引量
操作
1
衬底寄生电阻对高压器件ESD性能的影响
林丽娟
喻钊
韩山明
蒋苓利
张波
《微电子学》
CAS
CSCD
北大核心
2011
1
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职称材料
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